參數(shù)資料
型號(hào)： MPC8358CZQAGDGA
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 400 MHz, RISC PROCESSOR, PBGA668
封裝： 29 X 29 MM, 1.46 MM HEIGHT, 1 MM PITCH, PLASTIC, BGA-668
文件頁數(shù)： 77/95頁
文件大?。?/td> 1225K
代理商： MPC8358CZQAGDGA
MPC8358E PowerQUICC II Pro Processor Revision 2.1 PBGA Silicon Hardware Specifications, Rev. 3
Freescale Semiconductor
79
Clocking
NOTE
Core VCO frequency = Core frequency × VCO divider. The VCO divider
(RCWL[COREPLL[0:1]]) must be set properly so that the core VCO
frequency is in the range of 800–1800 MHz. Having a core frequency below
the CSB frequency is not a possible option because the core frequency must
be equal to or greater than the CSB frequency.
22.3
QUICC Engine Block PLL Configuration
The QUICC Engine block PLL is controlled by the RCWL[CEPMF], RCWL[CEPDF], and
RCWL[CEVCOD] parameters. Table 72 shows the multiplication factor encodings for the QUICC Engine
block PLL.
11
0001
11.5:1
÷8
00
0010
02:1
÷2
01
0010
02:1
÷4
10
0010
02:1
÷8
11
0010
02:1
÷8
00
0010
12.5:1
÷2
01
0010
12.5:1
÷4
10
0010
12.5:1
÷8
11
0010
12.5:1
÷8
00
0011
03:1
÷2
01
0011
03:1
÷4
10
0011
03:1
÷8
11
0011
03:1
÷8
Table 72. QUICC Engine Block PLL Multiplication Factors
RCWL[CEPMF] RCWL[CEPDF]
QUICC Engine PLL
Multiplication Factor = RCWL[CEPMF]/
(1 + RCWL[CEPDF])
00000
0
× 16
00001
0
Reserved
00010
0
× 2
00011
0
× 3
00100
0
× 4
Table 71. e300 Core PLL Configuration (continued)
RCWL[COREPLL]
core_clk:csb_clk
Ratio
VCO divider
0–1
2–5
6
相關(guān)PDF資料
PDF描述
MPC8358ECVRAGDGA 32-BIT, 400 MHz, RISC PROCESSOR, PBGA668
MPC8358ZQADDGA 32-BIT, 266 MHz, RISC PROCESSOR, PBGA668
MPC8358ZQADDDA 32-BIT, 266 MHz, RISC PROCESSOR, PBGA668
MPC8358ZQAGDDA 32-BIT, 400 MHz, RISC PROCESSOR, PBGA668
MPC8360ECVVALDGA 32-BIT, 667 MHz, RISC PROCESSOR, PBGA740
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參數(shù)描述
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MPC8358CZUADDGA 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8360E/MPC8358E PowerQUICC II Pro Processor
MPC8358CZUAGDEA 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8360E/MPC8358E PowerQUICC II Pro Processor
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