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參數(shù)資料
| 型號(hào)： | MPC5567EVBE |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 40/68頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVALUATION MPC5567 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | MPC5567MZP132 |
| 所含物品： | 板，線纜，CD，ICD，電源 |
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Electrical Characteristics
MPC5567 Microcontroller Data Sheet, Rev. 2
Freescale
45
3.13.9
eQADC SSI Timing
Figure 27. EQADC SSI Timing
Table 27. EQADC SSI Timing Characteristics
Spec
Rating
Symbol
Minimum
Typical
Maximum
Unit
2
FCK period (tFCK = 1 fFCK) 1, 2
1 SS timing specified at VDDEH = 3.0–5.25 V, TA = TL to TH, and CL = 25 pF with SRC = 0b11. Maximum operating frequency
varies depending on track delays, master pad delays, and slave pad delays.
2 FCK duty cycle is not 50% when it is generated through the division of the system clock by an odd number.
tFCK
2—
17
tSYS_CLK
3
Clock (FCK) high time
tFCKHT
tSYS_CLK 6.5
—
9
(tSYS_CLK 6.5)
ns
4
Clock (FCK) low time
tFCKLT
tSYS_CLK 6.5
—
8
(tSYS_CLK 6.5)
ns
5
SDS lead / lag time
tSDS_LL
–7.5
—
+7.5
ns
6
SDO lead / lag time
tSDO_LL
–7.5
—
+7.5
ns
7
EQADC data setup time (inputs)
tEQ_SU
22
—
ns
8
EQADC data hold time (inputs)
tEQ_HO
1—
—
ns
1st (MSB)
2nd
25th
26th
1st (MSB) 2nd
25th
26th
8
7
5
6
4
5
4
2
3
FCK
SDS
SDO
External device data sample at
SDI
EQADC data sample at
FCK falling-edge
FCK rising-edge
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| RCM10DTKH | CONN EDGECARD 20POS DIP .156 SLD |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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