參數(shù)資料
型號: MFR4200MPB40
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 2 CHANNEL(S), 10M bps, SERIAL COMM CONTROLLER, PQFP64
封裝: 10 X 10 MM, 1.40 MM HEIGHT, 0.50 PITCH, MS-026BCD, LQFP-64
文件頁數(shù): 129/260頁
文件大?。?/td> 1599K
代理商: MFR4200MPB40
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Clocks and Reset Generator
MFR4200 Data Sheet, Rev. 1
214
Freescale Semiconductor
5.2
Functional Description
5.2.1
MFR4200 Pins Relevant to the CRG
5.2.2
Reset Generation and CLKOUT Control
The CRG will provide a system reset on any of the following events: power-on, low voltage, or low level
detected at the RESET# pin. Entry into reset is asynchronous and does not require a clock; however, the
MFR4200 cannot sequence out of reset in functional mode without a system clock.
The CRG scans, during different periods depending on the origin of the reset source, the interface and
CLKOUT selector pins: IF_SEL[0:1] and CLK_S[0:1].
Table 5-1. MFR4200 Pins Relevant to the CRG
Pin N
Pin Name
In/Out
Pin type1
1 PC (Pullup/down Controlled) – Register controlled internal weak pull up/down for a pin in the input mode.
PD (Pull Down) – Internal weak pull down for a pin in the input mode.
DC (Drive strength Controlled) – Register controlled drive strength for a pin in the output mode.
Z – Three-stated pin.
OD (Open Drain) – Output pin with open drain.
Reset state:
– All pins with the PC option have pullup/down resistors disabled.
– All pins with the DC option have full drive strength.
Functional Description
1
TEST
I
-
This pin must be tied to logic ‘0’.
16
RESET#
I
-
Hardware reset input
24
EXTAL/CC_CLK
I
-
Crystal driver / External clock pin
25
XTAL
I
-
Crystal driver pin
32
BGT/DBG2/IF_SEL0
I/O
DC/PD
Bus guardian tick / Debug strobe point signal 2 / Host interface
selection 0
41
TXD_BG1/TXD1_485/
IF_SEL1
I/O
DC/PD
PHY data transmitter output / RS485 data transmitter output /
Host interface selection 1
47
ARM/DBG1/CLK_S0
I/O
DC/PD
Bus guardian ARM signal / Debug strobe point signal 1 /
Controller clock output select signal 0
48
MT/CLK_S1
I/O
DC/PD
Bus guardian macrotick / Controller clock output select signal 1
52
ECLK_CC
I
PC
HCS12 clock input
63
CLKOUT
I/O
DC
CLKOUT output, selectable as disabled or 4/10/40 MHz.
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