參數(shù)資料
型號(hào): MD80C52EXXX-20P883
廠商: TEMIC SEMICONDUCTORS
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40
文件頁(yè)數(shù): 36/336頁(yè)
文件大小: 8801K
代理商: MD80C52EXXX-20P883
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ATmega16M1/32M1/64M1 [DATASHEET]
8209E–AVR–11/2012
Figure 17-3. Cycle presentation in Centered mode.
Figure 17-2 on page 129 and Figure 17-3 graphically illustrate the values held in the PSC counter. Centered mode
is like One Ramp mode which counts down and then up.
Notice that the update of the waveform generator registers is done regardless of ramp mode at the end of the PSC
cycle.
17.5.3
Operation mode descriptions
Waveforms and duration of output signals are determined by parameters held in the registers (POCRnSA,
POCRnRA, POCRnSB, POCR_RB) and by the running mode. Two modes are possible:
One Ramp Mode. In this mode, all the three PSCOUTnB outputs are edge-aligned and the three PSCOUTnA
can be also edge-aligned when setting the same values in the dedicated registers.
In this mode, the PWM frequency is twice the Center Aligned mode PWM frequency
Center Aligned Mode. In this mode, all the six PSC outputs are aligned at the center of the period. Except when
using the same duty cycles on the three modules, the edges of the outputs are not aligned. So the PSC outputs
do not commute at the same time, thus the system which is driven by these outputs will generate less
commutation noise.
In this mode, the PWM frequency is twice as slow as in One Ramp mode
17.5.3.1
One Ramp mode (edge-aligned)
The following figure shows the resultant outputs PSCOUTnA and PSCOUTnB operating in one ramp mode over a
PSC cycle.
One PSC cycle
UPDATE
PSC counter value
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PDF描述
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MD80C52EXXX-36SB 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CDIP40
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