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參數(shù)資料
| 型號(hào)： | MD80C52EXXX-20P883 |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁數(shù)： | 320/336頁 |
| 文件大?。?/td> | 8801K |
| 代理商： | MD80C52EXXX-20P883 |
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84
ATmega16M1/32M1/64M1 [DATASHEET]
8209E–AVR–11/2012
Be aware that the COM0x1:0 bits are not double buffered together with the compare value. Changing the
COM0x1:0 bits will take effect immediately.
14.6
Compare Match Output Unit
The Compare Output mode (COM0x1:0) bits have two functions. The Waveform Generator uses the COM0x1:0
bits for defining the Output Compare (OC0x) state at the next compare match. Also, the COM0x1:0 bits control the
OC0x pin output source. Figure 14-4 shows a simplified schematic of the logic affected by the COM0x1:0 bit set-
ting. The I/O Registers, I/O bits, and I/O pins in the figure are shown in bold. Only the parts of the general I/O port
control registers (DDR and PORT) that are affected by the COM0x1:0 bits are shown. When referring to the OC0x
state, the reference is for the internal OC0x Register, not the OC0x pin. If a system reset occur, the OC0x Register
is reset to “0”.
Figure 14-4. Compare Match Output Unit, schematic.
The general I/O port function is overridden by the Output Compare (OC0x) from the Waveform Generator if either
of the COM0x1:0 bits are set. However, the OC0x pin direction (input or output) is still controlled by the Data Direc-
tion Register (DDR) for the port pin. The Data Direction Register bit for the OC0x pin (DDR_OC0x) must be set as
output before the OC0x value is visible on the pin. The port override function is independent of the Waveform Gen-
erating mode.
The design of the Output Compare pin logic allows initialization of the OC0x state before the output is enabled.
Note that some COM0x1:0 bit settings are reserved for certain modes of operation. See “Register description” on
14.6.1
Compare output mode and waveform generating
The Waveform Generator uses the COM0x1:0 bits differently in Normal, CTC, and PWM modes. For all modes,
setting the COM0x1:0 = 0 tells the Waveform Generator that no action on the OC0x Register is to be performed on
the next compare match. For compare output actions in the non-PWM modes refer to Table 14-2 on page 91. For
fast PWM mode, refer to Table 14-3 on page 91, and for phase correct PWM refer to Table 14-4 on page 91.
A change of the COM0x1:0 bits state will have effect at the first compare match after the bits are written. For non-
PWM modes, the action can be forced to have immediate effect by using the FOC0x strobe bits.
PORT
DDR
DQ
OCnx
pin
OCnx
DQ
Waveform
generator
COMnx1
COMnx0
0
1
D
ATA
B
U
S
FOCn
clk
I/O
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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