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參數(shù)資料
| 型號(hào)： | MD80C32-20SC |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 20 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁(yè)數(shù)： | 283/313頁(yè) |
| 文件大小： | 4988K |
| 代理商： | MD80C32-20SC |
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71
32000D–04/2011
AVR32
8.3.1.8
INT3 Exception
The INT3 exception is generated when the INT3 input line to the core is asserted. The INT3
exception can be masked by the SR[GM] bit, and the SR[I3M] bit. Hardware automatically sets
the SR[I3M] bit when accepting an INT3 exception, inhibiting new INT3 requests when process-
ing an INT3 request.
The INT3 Exception handler address is calculated by adding EVBA to an interrupt vector offset
specified by an interrupt controller outside the core. The interrupt controller is responsible for
providing the correct offset.
Since the INT3 exception is unrelated to the instruction stream, the instructions in the pipeline
are allowed to complete. After finishing the INT3 exception routine, execution should continue at
the instruction following the last completed instruction in the instruction stream.
*(--SP
SYS)
= R8;
*(--SP
SYS)
= R9;
*(--SP
SYS)
= R10;
*(--SP
SYS)
= R11;
*(--SP
SYS)
= R12;
*(--SP
SYS)
= LR;
*(--SP
SYS)
= PC of first noncompleted instruction;
*(--SP
SYS)
= SR;
SR[R] = 0;
SR[J] = 0;
SR[M2:M0] = B’101;
SR[I3M] = 1;
SR[I2M] = 1;
SR[I1M] = 1;
SR[I0M] = 1;
PC = EVBA + INTERRUPT_VECTOR_OFFSET;
8.3.1.9
INT2 Exception
The INT2 exception is generated when the INT2 input line to the core is asserted. The INT2
exception can be masked by the SR[GM] bit, and the SR[I2M] bit. Hardware automatically sets
the SR[I2M] bit when accepting an INT2 exception, inhibiting new INT2 requests when process-
ing an INT2 request.
The INT2 Exception handler address is calculated by adding EVBA to an interrupt vector offset
specified by an interrupt controller outside the core. The interrupt controller is responsible for
providing the correct offset.
Since the INT2 exception is unrelated to the instruction stream, the instructions in the pipeline
are allowed to complete. After finishing the INT2 exception routine, execution should continue at
the instruction following the last completed instruction in the instruction stream.
*(--SP
SYS)
= R8;
*(--SP
SYS)
= R9;
*(--SP
SYS)
= R10;
*(--SP
SYS)
= R11;
*(--SP
SYS)
= R12;
*(--SP
SYS)
= LR;
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