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參數資料
| 型號： | MCIMX27LVOP4A |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 99/152頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LOW END I.MX27 404-MAPBGA |
| 視頻文件： | i.MX27 Multimedia Application Processor |
| 標準包裝： | 90 |
| 系列： | i.MX27 |
| 核心處理器： | ARM9 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | 1 線，CAN，EBI/EMI，以太網，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外圍設備： | DMA，LCD，POR，PWM，WDT |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 45K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.38 V ~ 1.52 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -20°C ~ 85°C |
| 封裝/外殼： | 404-LFBGA |
| 包裝： | 托盤 |
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i.MX27 and i.MX27L Data Sheet, Rev. 1.8
50
Freescale Semiconductor
Electrical Characteristics
Figure 9 shows sensor output data on the pixel clock falling edge. The CSI latches data on the pixel clock
rising edge.
Figure 9. CSI Timing Diagram, Gated, PIXCLK—Sensor Data at Falling Edge, Latch Data at Rising Edge
Figure 10 shows sensor output data on the pixel clock rising edge. The CSI latches data on the pixel clock
falling edge.
Figure 10. CSI Timing Diagram, Gated, PIXCLK—Sensor Data at Rising Edge, Latch Data at Falling Edge
VSYNC
HSYNC
PIXCLK
DATA[7:0]
Valid Data
1
2
34
56
7
VSYNC
HSYNC
PIXCLK
DATA[7:0]
Valid Data
1
2
34
56
7
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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| MCIMX27MJP4AR2 | 功能描述:處理器 - 專門應用 Bono 19x19 FG RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數據總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數據緩存: 數據 RAM 大小:128 KB 數據 ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
| MCIMX27MOP4A | 功能描述:處理器 - 專門應用 BONO 19X19 FG RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數據總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數據緩存: 數據 RAM 大小:128 KB 數據 ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
| MCIMX27MOP4AR2 | 功能描述:處理器 - 專門應用 BONO 19X19 R2 RoHS:否 制造商:Freescale Semiconductor 類型:Multimedia Applications 核心:ARM Cortex A9 處理器系列:i.MX6 數據總線寬度:32 bit 最大時鐘頻率:1 GHz 指令/數據緩存: 數據 RAM 大小:128 KB 數據 ROM 大小: 工作電源電壓: 最大工作溫度:+ 95 C 安裝風格:SMD/SMT 封裝 / 箱體:MAPBGA-432 |
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