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參數資料
| 型號： | MCF5480 |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | MCF548x ColdFire㈢ Microprocessor |
| 中文描述： | MCF548x微處理器的ColdFire㈢ |
| 文件頁數： | 25/34頁 |
| 文件大?。?/td> | 403K |
| 代理商： | MCF5480 |
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General Timing Specifications
MCF548x ColdFire
Microprocessor, Rev. 4
Freescale Semiconductor
25
12
General Timing Specifications
Table 19
lists timing specifications for the GPIO, PSC, FlexCAN, DREQ, DACK, and external interrupts.
13
Table 20
lists specifications for the I
2
C input timing parameters shown in
Figure 23
.
Table 20. I
2
C Input Timing Specifications between SCL and SDA
I
2
C Input/Output Timing Specifications
Table 21
lists specifications for the I
2
C output timing parameters shown in
Figure 23
.
Table 21. I
2
C Output Timing Specifications between SCL and SDA
Table 19. General AC Timing Specifications
Name
Characteristic
Min
Max
Unit
G1
CLKIN high to signal output valid
—
2
PSTCLK
G2
CLKIN high to signal invalid (output hold)
0
—
ns
G3
Signal input pulse width
2
—
PSTCLK
Num
Characteristic
Min
Max
Units
I1
Start condition hold time
2
—
Bus clocks
I2
Clock low period
8
—
Bus clocks
I3
SCL/SDA rise time (V
IL
= 0.5 V to V
IH
= 2.4 V)
Data hold time
—
1
mS
I4
0
—
ns
I5
SCL/SDA fall time (V
IH
= 2.4 V to V
IL
= 0.5 V)
Clock high time
—
1
mS
I6
4
—
Bus clocks
I7
Data setup time
0
—
ns
I8
Start condition setup time (for repeated start condition only)
2
—
Bus clocks
I9
Stop condition setup time
2
—
Bus clocks
Num
Characteristic
Min
Max
Units
I1
1
I2
1
I3
2
I4
1
I5
3
I6
1
I7
1
I8
1
Start condition hold time
6
—
Bus clocks
Clock low period
10
—
Bus clocks
SCL/SDA rise time (V
IL
= 0.5 V to V
IH
= 2.4 V)
Data hold time
—
—
μS
7
—
Bus clocks
SCL/SDA fall time (V
IH
= 2.4 V to V
IL
= 0.5 V)
Clock high time
—
3
ns
10
—
Bus clocks
Data setup time
2
—
Bus clocks
Start condition setup time (for repeated start
condition only)
20
—
Bus clocks
I9
1
Stop condition setup time
10
—
Bus clocks
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參數描述 |
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