參數(shù)資料
型號(hào)： MCF5249LPV120
廠商： MOTOROLA INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, 120 MHz, RISC PROCESSOR, PQFP144
封裝： 20 X 20 X 1.4 MM, 0.50 MM PITCH, LQFP-144
文件頁(yè)數(shù)： 43/446頁(yè)
文件大?。?/td> 5856K
代理商： MCF5249LPV120
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SIM Programming and Configuration
MOTOROLA
Section 9 System Integration Module
9-5
The following example shows how to set the MBAR to location $10000000 using the D0 register. A “1” in
the least significant bit validates the MBAR location. This example assumes that all accesses are valid:
move.1 #$10000001,DO
movec DO,MBAR
9.3.2
DEVICE ID
The DeviceID register is a read only register that allows the software to determine which hardware it is
running on. The register contains the part number in the upper 24 bits, the mask revision number in the
lower 8 bits, and is read as 0x005448rr, where rr is the revision number.
This register allows developers the flexibility to write code to run on more than one device. The revision
number allows developers to distinguish between different mask versions that may have minor changes or
V
This bit defines when the base address is valid:
0 = MBAR address space not visible by CPU
1 = MBAR address space visible by CPU
Table 9-5 Second Module Base Address Register (MBAR2)
BITS
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
FIELD
BA31
BA30
--------------
RESET
0
--------------
R/W
BITS
15
14
13
12
11
10
9876543210
FIELD
LS7
LS6
LS5
LS4
LS3
LS2
LS1
V
RESET
--------
00000000
R/W
Table 9-6 Second Module Base Address Bit Descriptions
BIT NAME
DESCRIPTION
BA[31:30]
The Base Address field defines the base address for a 1024-MByte address range. If V-bit in
MBAR2 is set, address range Base Address to BaseAddress + $3FFF FFFF are mapped to
MBAR2 space, and cannot be used for MBAR, SDRAM or Chip Select.
LS[7:1]
If interrupts both “primary” and the “secondary” interrupt controller have interrupt level 7
pending, bit LS7 determines which interrupt controller gets priority. If this bit is cleared, the
primary interrupt controller gets priority. If this bit is set, the secondary interrupt controller
gets priority. There are 7 LSn bits, one for each interrupt level.
V
The Valid bit defines if the CPU can access the MBAR2 mapped peripherals
0 = MBAR2 address space not visible by CPU.
1 = MBAR2 address space visible by CPU
Table 9-4 Module Base Address Bit Descriptions
BIT NAME
DESCRIPTION
相關(guān)PDF資料
PDF描述
MCF5251VM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF5251CVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCH4008 L BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MCH4009 40 mA, 3.5 V, NPN, Si, SMALL SIGNAL TRANSISTOR
MCH4009 40 mA, 3.5 V, NPN, Si, SMALL SIGNAL TRANSISTOR
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MCF5249PB 制造商:MOTOROLA 制造商全稱(chēng):Motorola, Inc 功能描述:system controller/decoder
MCF5249VF140 功能描述:微處理器 - MPU 140MHz 125MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線(xiàn)寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類(lèi)型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MCF5249VM140 功能描述:IC MPU 32B 140MHZ COLDF 160-BGA RoHS:是 類(lèi)別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:MCF524x 標(biāo)準(zhǔn)包裝:1 系列:87C 核心處理器:MCS 51 芯體尺寸:8-位 速度:16MHz 連通性:SIO 外圍設(shè)備:- 輸入/輸出數(shù):32 程序存儲(chǔ)器容量:8KB（8K x 8） 程序存儲(chǔ)器類(lèi)型:OTP EEPROM 大小:- RAM 容量:256 x 8 電壓 - 電源 (Vcc/Vdd):4 V ~ 6 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:外部 工作溫度:0°C ~ 70°C 封裝/外殼:44-DIP 包裝:管件 其它名稱(chēng):864285
MCF5251 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251_07 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet
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