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參數(shù)資料
| 型號： | MCF5249LPV120 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 120 MHz, RISC PROCESSOR, PQFP144 |
| 封裝： | 20 X 20 X 1.4 MM, 0.50 MM PITCH, LQFP-144 |
| 文件頁數(shù)： | 273/446頁 |
| 文件大小： | 5856K |
| 代理商： | MCF5249LPV120 |
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19-4
MCF5249UM
MOTOROLA
Real-Time Trace Support
19.2
REAL-TIME TRACE SUPPORT
In the area of debug functions, one fundamental requirement is support for real-time trace functionality. For
example, definition of the dynamic execution path. The ColdFire solution is to include a parallel output port
providing encoded processor status and data to an external development system. This port is partitioned
into two nibbles (4 bits): one nibble allows the processor to transmit information concerning the execution
status of the core (processor status: PST), while the other nibble allows operand data to be displayed.
(debug data: DDATA). The processor status (PST) timing is synchronous with the processor status clock
(PSTCLK) and may not be related to the current bus transfer. Table 19-1 shows the encoding of these
signals.
The PST outputs can be used with an external image of the program to completely track the dynamic
execution path of the machine when used with external development systems. The tracking of this
dynamic path is complicated by any change-of-flow operation. This is especially evident when the branch
target address is calculated based on the contents of a program-visible register (variant addressing.) For
this reason, the DDATA outputs can be configured to display the target address of these types of
change-of-flow instructions. Because the DDATA bus is only 4 bits wide, the address is displayed a nibble
at a time across multiple clock cycles.
The debug module includes two 32-bit storage elements for capturing the internal ColdFire bus
information. These two elements effectively form a FIFO buffer connecting the processor’s high-speed
local bus to the external development system through the DDATA signals. The FIFO buffer captures
branch target addresses along with certain operand data values for eventual display on the DDATA output
port, a nibble at a time, starting with the least-significant bit. The execution speed of the ColdFire
processor is affected only when both storage elements contain valid data waiting to be dumped onto the
DDATA port. In this case, the processor core is stalled until one FIFO entry is available. In all other cases,
data output on the DDATA port does not impact execution speed.
19.2.1
PROCESSOR STATUS SIGNAL ENCODING
The PST signals are encoded to reflect the state of the Operand Execution Pipeline, and are generally not
related to the current external bus transfer.
19.2.1.1
Continue Execution (PST = $0)
Many instructions complete in a single processor cycle. If an instruction requires more clock cycles, the
subsequent clock cycles are indicated by driving the PST outputs with this encoding.
19.2.1.2
Begin Execution of an Instruction (PST = $1)
For most instructions, this encoding signals the first clock cycle of an instruction’s execution. Certain
change-of-flow opcodes, plus the PULSE and WDDATA instructions generate different encodings.
19.2.1.3
Entry into User Mode (PST = $3)
This encoding indicates the ColdFire processor has entered user mode. This encoding is signaled after the
instruction which caused the user mode entry has executed.
19.2.1.4
Begin Execution of PULSE or WDDATA instructions (PST = $4)
The ColdFire instruction set architecture includes a PULSE opcode. This opcode generates a unique PST
encoding, $4, when executed. This instruction can define logic analyzer triggers for debug and/or
performance analysis. Additionally, a WDDATA instruction is supported that allows the processor core to
write any operand (byte, word, longword) directly to the DDATA port, independent of any debug module
configuration. This opcode also generates the special PST encoding ($4) when executed, followed by the
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCF5251VM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCF5251CVM140 | 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225 |
| MCH4008 | L BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR |
| MCH4009 | 40 mA, 3.5 V, NPN, Si, SMALL SIGNAL TRANSISTOR |
| MCH4009 | 40 mA, 3.5 V, NPN, Si, SMALL SIGNAL TRANSISTOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MCF5249PB | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:system controller/decoder |
| MCF5249VF140 | 功能描述:微處理器 - MPU 140MHz 125MIPS RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MCF5249VM140 | 功能描述:IC MPU 32B 140MHZ COLDF 160-BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:MCF524x 標準包裝:1 系列:87C 核心處理器:MCS 51 芯體尺寸:8-位 速度:16MHz 連通性:SIO 外圍設(shè)備:- 輸入/輸出數(shù):32 程序存儲器容量:8KB（8K x 8） 程序存儲器類型:OTP EEPROM 大小:- RAM 容量:256 x 8 電壓 - 電源 (Vcc/Vdd):4 V ~ 6 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:外部 工作溫度:0°C ~ 70°C 封裝/外殼:44-DIP 包裝:管件 其它名稱:864285 |
| MCF5251 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor |
| MCF5251_07 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet |
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