參數(shù)資料
型號： MC9S12KC128CPU
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 57/126頁
文件大小： 7307K
代理商： MC9S12KC128CPU
Device User Guide — 9S12KT256DGV1/D V01.09
57
Freescale Semiconductor
2.2 Signal Properties Summary
(Table 2-1)
summarizes the pin functionality. Signals shown in
bold
are not available in the 80 pin
package.
(Table 2-2)
summarizes the power and ground pins.
Table 2-1 Signal Properties
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Pin Name
Function 4
Powered
by
Internal Pull
Resistor
Description
CTRL
Reset
State
NA
NA
None
NA
NA
NA
EXTAL
XTAL
RESET
TEST
VREGEN
XFC
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
VDDPLL
VDDPLL
VDDR
NA
VDDX
VDDPLL
NA
NA
None
NA
NA
NA
Always
Up
Oscillator Pins
External Reset
Test Input
Voltage Regulator Enable Input
PLL Loop Filter
Background Debug, Tag High, Mode
Input
Port AD Input, Analog Inputs of ATD
in MC9S12KG128(64)(32),
MC9S12KL128(64) and
MC9S12KC128(64); Analog Inputs of
ATD1 in MC9S12KT256 and
MC9S12KG256
Port AD Input, Analog Inputs of ATD in
MC9S12KG128(64)(32),
MC9S12KL128(64) and
MC9S12KC128(64); Analog Inputs of
ATD0 in MC9S12KT256 and
MC9S12KG256
BKGD
TAGHI
MODC
—
VDDR
Up
PAD[15:8]
AN[15:8]
AN1[7:0]
1
—
VDDA
None
None
PAD[7:0]
AN[7:0]
AN0[7:0]
1
—
VDDA
None
None
PA[7:0]
ADDR[15:8]/
DATA[15:8]
ADDR[7:0]/
DATA[7:0]
NOACC
—
—
VDDR
PUCR
Disabled Port A I/O, Multiplexed Address/Data
PB[7:0]
—
—
VDDR
PUCR
Disabled Port B I/O, Multiplexed Address/Data
PE7
XCLKS
—
VDDR
PUCR
While RESET
pin is low:
Down
While RESET
pin is low:
Down
PUCR
PUCR
PUCR
Up
Port E I/O, Access, Clock Select
PE6
IPIPE1
MODB
—
VDDR
Port E I/O, Pipe Status, Mode Input
PE5
IPIPE0
MODA
—
VDDR
Port E I/O, Pipe Status, Mode Input
PE4
PE3
PE2
PE1
PE0
ECLK
LSTRB
R/W
IRQ
XIRQ
—
—
—
—
—
—
VDDR
VDDR
VDDR
VDDR
VDDR
Up
Up
Up
Port E I/O, Bus Clock Output
Port E I/O, Byte Strobe, Tag Low
Port E I/O, R/W in expanded modes
Port E Input, Maskable Interrupt
Port E Input, Non Maskable Interrupt
TAGLO
—
—
—
Always Up
PH7
KWH7
SS2
—
VDDR
PERH/
PPSH
Disabled Port H I/O, Interrupt, SS of SPI2
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