參數(shù)資料
型號(hào)： MC9328MX1VH20R2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 200 MHz, RISC PROCESSOR, PBGA256
封裝： 14 X 14 MM, 1.30 MM HEIGHT, 0.80 MM PITCH, MAPBGA-256
文件頁數(shù)： 18/96頁
文件大?。?/td> 1486K
代理商： MC9328MX1VH20R2
Specifications
MC9328MX1 Advance Information, Rev. 4.1
Freescale Semiconductor
25
3.9.2.2 DTACK Read Cycle DMA Enabled
Figure 7. DTACK Read Cycle DMA Enabled
5
DTACK asserted to OE negated
3T+2.2
4T+6.86
ns
6
Data hold timing after OE negated
0
–
ns
7
Data ready after DTACK asserted
0
T
ns
8
OE negated to CS negated
0.5T+0.24
0.5T+0.67
ns
9
OE negated after EB negated
0.5
1.5
ns
10
DTACK pulse width
1T
3T
ns
Note:
0. DTACK assert means DTACK become low level.
1. T is the system clock period. (For 96MHz system clock)
2. OE and EB assertion time is programmable by OEA bit in CS5L register. EB assertion in read cycle will occur
only when EBC bit in CS5L register is clear.
3. Address becomes valid and CS asserts at the start of read access cycle.
4. The external DTACK input requirement is eliminated when CS5 is programmed to use internal wait state.
Table 14. Parameters for Read Cycle, WSC = 111111, DTACK_SEL=0, HKCL=96MHz (Continued)
Number
Characteristic
(3.0 ± 0.3) V
Unit
Minimum
Maximum
RW
DTACK
Address
EB
CS5
OE
(logic high)
Databus
programmable
min 0ns
(1)
(6)
(7)
(3)
(4)
(2)
(5)
(8)
(input to MX1)
(9)
(10)
(11)
相關(guān)PDF資料
PDF描述
MC9328MX1CVH15 150 MHz, RISC PROCESSOR, PBGA256
MC9328MX1VH20 200 MHz, RISC PROCESSOR, PBGA256
MC9328MX1VH15 150 MHz, MICROPROCESSOR, PBGA256
MC9328MX1VM15 32-BIT, 150 MHz, RISC PROCESSOR, PBGA256
MC9328MX1CVM15R2 32-BIT, 150 MHz, RISC PROCESSOR, PBGA256
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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MC9328MX21 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:i.MX family of microprocessors
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