MC68HC908LD64 — Rev. 3.0 298 Input/Output (I" />
參數(shù)資料
型號(hào)： MC908LD64IFUE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 221/362頁(yè)
文件大小： 0K
描述： IC MCU 8BIT FOR LCD 64-QFP
標(biāo)準(zhǔn)包裝： 420
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 6MHz
連通性： I²C，USB
外圍設(shè)備： OSD，POR，PWM
輸入/輸出數(shù)： 39
程序存儲(chǔ)器容量： 60KB（60K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x8b
振蕩器型： 內(nèi)部
工作溫度： 0°C ~ 85°C
封裝/外殼： 64-QFP
包裝： 托盤(pán)
產(chǎn)品目錄頁(yè)面： 725 (CN2011-ZH PDF)
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Input/Output (I/O) Ports
Data Sheet
MC68HC908LD64 — Rev. 3.0
298
Input/Output (I/O) Ports
Freescale Semiconductor
19.3.2 Data Direction Register A
Data direction register A (DDRA) determines whether each port A pin is
an input or an output. Writing a logic 1 to a DDRA bit enables the output
buffer for the corresponding port A pin; a logic 0 disables the output
buffer.
DDRA[7:0] — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears
DDRA[7:0], configuring all port A pins as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE:
Avoid glitches on port A pins by writing to the port A data register before
changing data direction register A bits from 0 to 1.
Figure 19-4 shows the port A I/O logic.
Figure 19-4. Port A I/O Circuit
Address:
$0004
Bit 7
6
54
32
1
Bit 0
Read:
DDRA7
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
000
00
0
Figure 19-3. Data Direction Register A (DDRA)
READ DDRA ($0004)
WRITE DDRA ($0004)
RESET
WRITE PTA ($0000)
READ PTA ($0000)
PTAx
DDRAx
PTAx
INT
ERNAL
D
AT
A
B
U
S
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PDF描述
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