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參數(shù)資料
| 型號： | MC80C0216Q |
| 廠商： | Electronic Theatre Controls, Inc. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-BIT SINGLE-CHIP MICROCONTROLLERS |
| 中文描述： | 8位單晶片微控制器 |
| 文件頁數(shù)： | 46/128頁 |
| 文件大小： | 1408K |
| 代理商： | MC80C0216Q |
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MC80F0208/16/24
Preliminary
42
MAR. 2005 Ver 0.2
Figure 11-2 BITR: Basic Interval Timer Mode Register
Example 1:
Interrupt request flag is generated every 8.192ms at 4MHz.
:
LDM
SET1
EI
:
CKCTLR,#1BH
BITE
Example 2:
Interrupt request flag is generated every 8.192ms at 8MHz.
:
LDM
SET1
EI
:
CKCTLR,#1CH
BITE
BTCL
7
6
-
5
4
3
2
1
0
RCWDT
ADRST
BTS1
Basic Interval Timer source clock select
000: f
XIN
÷
8
001: f
XIN
÷
16
010: f
XIN
÷
32
011: f
XIN
÷
64
100: f
XIN
÷
128
101: f
XIN
÷
256
110: f
XIN
÷
512
111: f
XIN
÷
1024
Clear bit
0: Normal operation (free-run)
1: Clear 8-bit counter (BITR) to “0”. This bit becomes 0 automatically
after one machine cycle, and starts counting.
INITIAL VALUE: 0-01 0111
B
ADDRESS: 0F2
CKCTLR
INITIAL VALUE: Undefined
ADDRESS: 0F2
BITR
Both register are in same address,
when write, to be a CKCTLR,
when read, to be a BITR.
Caution:
8-BIT FREE-RUN BINARY COUNTER
WDTON
BTS0
BTS2
BTCL
7
6
5
4
3
2
1
0
Watchdog timer Enable bit
0: Operate as 7-bit Timer
1: Enable Watchdog Timer operation
See the section “Watchdog Timer”.
Address Trap Reset Selection
0: Enable Address Fail Reset
1: Disable Address Fail Reset
0: Disable Internal RC Watchdog Timer
1: Enable Internal RC Watchdog Timer
RC Watchdog Selection bit
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PDF描述 |
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