參數(shù)資料
型號： MC7455ARX867LG
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 867 MHz, RISC PROCESSOR, CBGA483
封裝： 29 X 29 MM, 1.27 MM PITCH, CERAMIC, BGA-483
文件頁數(shù)： 20/76頁
文件大小： 1520K
代理商： MC7455ARX867LG
MO
T
O
RO
L
A
M
P
C
7455
RIS
C
Mi
cro
p
ro
c
ess
o
rHa
rd
w
a
re
Sp
e
c
if
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tio
n
s
27
El
ect
ri
cal
a
n
d
T
h
e
rma
lCh
ar
act
er
ist
ics
Table 13. L3 Bus Interface AC Timing Specifications for PB2 and Late Write SRAMs
At recommended operating conditions. See Table 4.
Parameter
Symbol
All Speed Grades 6
Unit
Notes
L3OH0 = 0, L3OH1 = 0
L3OH0 = 0, L3OH1 =1
L3OH0 = 1, L3OH1 = 0 L3OH0 = 1, L3OH1 = 1
Min
Max
Min
Max
Min
Max
Min
Max
L3_CLK rise and fall time
tL3CR,
tL3CF
—1.0
ns
1, 5
Setup times: Data and parity
tL3DVEH
1.5—
ns
2, 5
Input hold times: Data and parity
tL3DXEH
—0.5
ns
2, 5
Valid times: Data and parity
tL3CHDV
—tL3_CLK/4
+ 1.00
—tL3_CLK/4
+ 0.80
—tL3_CLK/4
+ 0.60
—tL3_CLK/4
+ 0.40
ns
3, 4, 5
Valid times: All other outputs
tL3CHOV
—tL3_CLK/4
+ 1.00
—tL3_CLK/4
+ 0.80
—tL3_CLK/4
+ 0.60
—tL3_CLK/4
+ 0.40
ns
4
Output hold times: Data and
parity
tL3CHDX
tL3_CLK/4
– 0.40
—tL3_CLK/4
– 0.60
—tL3_CLK/4
– 0.80
—tL3_CLK/4
– 1.00
—ns
3, 4, 5
Output hold times: All other
outputs
tL3CHOX
tL3_CLK/4
– 0.40
—tL3_CLK/4
– 0.60
—tL3_CLK/4
– 0.80
—tL3_CLK/4
– 1.00
—ns
4, 5
L3_CLK to high impedance: Data
and parity
tL3CHDZ
—2.0
ns
5
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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