參數(shù)資料
型號(hào)： MC68SZ328VH66V
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 66 MHz, RISC PROCESSOR, PBGA196
封裝： 12 X 12 MM, 0.80 MM PITCH, MAPBGA-196
文件頁(yè)數(shù)： 515/650頁(yè)
文件大?。?/td> 10290K
代理商： MC68SZ328VH66V
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24-2
MC68SZ328 Reference Manual
MOTOROLA
In-Circuit Emulation
24.1 ICE Operation
The in-circuit emulation module’s operation consists of the following tasks:
Entering emulation mode
Detecting breakpoints
Using the signal decoder
Using the interrupt gate module
Using the A-line insertion unit
24.1.1 Entering Emulation Mode
The reset module will latch the state of the BST2~0 signal on the rising edge of the RESET signal. To put
the MC68SZ328 in emulation mode, the BST2~0 must be set to 001. For emulation mode, the CSA0 signal
is not asserted for reset fetch, because it is not in normal operation mode. The in-circuit emulation module
internally generates a reset vector to the processor on reset vector fetch cycles.
This hard-coded reset vector is PC = 0xFFFC0020 and SSP = 0xFFFCFFFC, which means that the
monitor or boot code must start at 0xFFFC0020. The EMUCS signal is designed to cover system memory
space from 0xFFFC0000 to 0xFFFDFFFF, and it is an 8-bit data bus width chip-select signal. If EMUIRQ
is logic high during system reset, the in-circuit emulation module is disabled and the MC68SZ328 begins
another operation mode.
24.1.2 Detecting Breakpoints
The execution breakpoint detector has one 32-bit address comparator and one control signal comparator.
When the in-circuit emulation module is configured to operate in single breakpoint mode, in which
EMUBRK is an output, the generation of the EMUBRK signal is internally qualified by the AS signal. The
active time for this signal will vary, depending on the setting and width (wait state) of the bus cycle. The
EMUBRK signal is asserted throughout the address matched cycle. When the in-circuit emulation module
is in multiple breakpoint mode, EMUBRK is an input that is asserted by the external address comparator.
The external address comparator will compare the lower address while the internal comparator, with
masking, compares the hidden address signals. The EMUBRK signal, together with the internal compare
result, generates the match signal to the breakpoint insertion unit.
Because the processor does not have built-in emulation support, the execution breakpoint is implemented
external to the core and will use the A-line instruction and level 7 interrupt. To accurately catch the
execution breakpoint, the in-circuit emulation module inserts the 0xA0000 opcode at the location where a
breakpoint is set. For more information regarding the insertion mechanism, refer to Section 24.1.5, “Using
the A-Line Insertion Unit.” When the 0xA000 opcode is being executed, which means the breakpoint is
reached, an exception vector fetch for an A-line exception will occur. At this point, EMUBRK is asserted
to stop the process and switch control to the emulation monitor (selected by the EMUCS signal).
An exception vector fetch for an A-line exception consists of two consecutive word reads at addresses
0x28 and 0x2A. The A-line exception vector fetch will cause an IRQ7 assertion if a breakpoint is activated
in emulation mode. However, normal memory reads to these two words will not cause an IRQ7 assertion.
24.1.2.1 Execution Breakpoints vs. Bus Breakpoints
An execution breakpoint is a breakpoint at which the current program execution stops and gives control to
the monitor. To set up a single execution breakpoint, initialize the compare and mask registers; set the SB,
PBEN, and CEN bits in the in-circuit emulation module control register (ICEMCR); and then clear the
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MC68VZ328CPV 制造商:FRESCL 功能描述:
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