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參數(shù)資料
| 型號(hào)： | MC68HC805K3DW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PDSO16 |
| 封裝： | SOIC-16 |
| 文件頁(yè)數(shù)： | 70/119頁(yè) |
| 文件大?。?/td> | 496K |
| 代理商： | MC68HC805K3DW |
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General Release Specication
Low-Power Modes
MC68HC805K3 — Rev. 1.0
54
Operational Modes
MOTOROLA
The mask option register bit enabling the execution of the STOP
instruction places the MCU in its lowest power consumption mode. In
stop mode, the internal oscillator is turned off, halting all internal
processing, including the COP watchdog timer.
When the CPU enters stop mode, the interrupt flags (TOF and RTIF) and
the interrupt enable bits (TOFE and RTIE) in the TSCR are cleared by
internal hardware to remove any pending timer interrupt requests and to
disable any further timer interrupts. Execution of the STOP instruction
automatically clears the I bit in the condition code register and sets the
IRQE enable bit in the IRQ status/control register so that the IRQ
external interrupt is enabled. All other memory and registers, including
the other bits in the TSCR, remain unaltered.
The MCU can be brought out of stop mode only by an IRQ external
interrupt, an IRQ from port A (if mask option register bit is enabled), or
an externally generated RESET. When exiting stop mode, the internal
oscillator resumes after an oscillator stabilization delay of either 16 or
4064 cycles (depending on mask option register bit state) of the internal
processor clock.
NOTE:
If enabled by a mask option register bit, the STOP instruction causes the
oscillator to stop and, therefore, disable the COP watchdog timer. If the
COP watchdog timer is used and the part is never intended to enter stop
mode, the mask option register bit that should be used is the one that
disables the STOP instruction and changes the stop mode to the halt
mode. See 6.3.4 COP Watchdog Timer Considerations for more
details.
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