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參數(shù)資料
| 型號(hào)： | MC68HC805K3DW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PDSO16 |
| 封裝： | SOIC-16 |
| 文件頁數(shù)： | 60/119頁 |
| 文件大?。?/td> | 496K |
| 代理商： | MC68HC805K3DW |
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General Release Specification
Hardware Interrupts
MC68HC805K3 — Rev. 1.0
MOTOROLA
Interrupts
45
Entering the interrupt service routine automatically clears the IRQ latch.
The IRQ interrupt service routine also may clear the IRQ latch by writing
a logic one to the IRQR acknowledge bit in the ISCR. As long as the
output state of the IRQF flag bit is active, the CPU continuously re-enters
the IRQ interrupt sequence following an RTI instruction until the active
state is removed or the IRQE enable bit is cleared.
4.6.2 IRQ Status/Control Register (ISCR)
The IRQ interrupt function is controlled by the ISCR located at $000A as
shown in Figure 4-4. All unused bits in the ISCR read as logic zeros. A
reset clears the IRQF bit and sets the IRQE bit.
IRQR — IRQ Interrupt Acknowledge
The IRQR acknowledge bit clears an IRQ interrupt request by
clearing the IRQ latch. If the IRQ latch is set again while in the IRQ
service routine (before an RTI instruction is executed), the CPU re-
enters the IRQ interrupt service routine unless the IRQ latch is
cleared. Writing a logic one to the IRQR acknowledge bit clears the
IRQ latch. Writing a logic zero to the IRQR acknowledge bit has no
effect on the IRQ latch. The IRQR acknowledge bit always reads as
a logic zero.
IRQF — IRQ Interrupt Request
The IRQF flag bit indicates that an IRQ request is pending. Writing to
the IRQF flag bit has no effect on it. The IRQF flag bit is cleared
automatically when the IRQ vector is fetched and the service routine
is entered. The IRQF flag bit also can be cleared by writing a logic one
to the IRQR acknowledge bit to clear the IRQ latch and also condition
$000A
Bit 7
654321
Bit 0
Read:
IRQE
0
IRQF
0
Write:
R
IRQR
Reset:
10000000
= Unimplemented
R
= Reserved
Figure 4-4. IRQ Status/Control Register
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