參數(shù)資料
型號： MC68HC711P2CFN4R2
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PQCC84
封裝： PLASTIC, LCC-84
文件頁數(shù)： 234/236頁
文件大小： 1232K
代理商： MC68HC711P2CFN4R2
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MC68HC11P2
MOTOROLA
5-17
SERIAL COMMUNICATIONS INTERFACE
5
5.8.2
SCI3
SCI3 shares I/O with two of port H’s pins: receive pin RXD3/PH4 and transmit pin TXD3/PD5. The
SCI receive and transmit functions are enabled by RE and TE respectively, in S3CR2.
The baud rate of this subsystem is controlled by the baud rate register for SCI2, hence the two
SCIs always have the same baud rate.
5.8.2.1
S3CR1 — SCI3 control register 1
The S3CR1 register provides the control bits that determine word length and select the method
used for the wakeup feature. Bit 5 has an MI BUS control function detailed below (for details of the
other bits see Section 5.6.2).
MIE3 — Motorola Interface Bus Enable 3
1 (set)
–
MI BUS is enabled for this subsystem.
0 (clear) –
The SCI functions normally.
When MIE3 is set, the SCI3 registers, bits and pins assume the functionality required for MI BUS.
5.8.2.2
S3CR2 — SCI3 control register 2
The S3CR2 register provides the control bits that enable or disable individual SCI functions. For
details of the bits, see Section 5.6.3.
5.8.2.3
S3SR1 — SCI3 status register 1
The bits in S3SR1 indicate certain conditions in the SCI hardware and are automatically cleared
by special acknowledge sequences. For details of the bits, see Section 5.6.4.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
SCI/MI 3 control 1 (S3CR1)
$005A
LOPS3 WOMS3 MIE3
M3
WAKE3
ILT3
PE3
PT3
0000 0000
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
SCI/MI 3 control 2 (S3CR2)
$005B
TIE3
TCIE3
RIE3
ILIE3
TE3
RE3
RWU3
SBK3 0000 0000
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
SCI/MI 3 status 1 (S3SR1)
$005C TDRE3
TC3
RDRF3 IDLE3
OR3
NF3
FE3
PF3
1100 0000
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PDF描述
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