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參數(shù)資料
| 型號： | MC68HC711P2CFN4R2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PQCC84 |
| 封裝： | PLASTIC, LCC-84 |
| 文件頁數(shù)： | 218/236頁 |
| 文件大?。?/td> | 1232K |
| 代理商： | MC68HC711P2CFN4R2 |
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MOTOROLA
5-2
MC68HC11P2
SERIAL COMMUNICATIONS INTERFACE
5
5.1
Data format
The serial data format requires the following conditions:
–
An idle-line condition before transmission or reception of a message.
–
A start bit, logic zero, transmitted or received, that indicates the start of each
character.
–
Data that is transmitted and received least signicant bit (LSB) rst.
–
A stop bit, logic one, used to indicate the end of a frame. (A frame consists
of a start bit, a character of eight or nine data bits, and a stop bit.)
–
A break (dened as the transmission or reception of a logic zero for some
multiple number of frames).
Selection of the word length is controlled by the M bit of SCCR1.
5.2
Transmit operation
The SCI transmitter includes a parallel data register (SCDRH/SCDRL) and a serial shift register.
The contents of the shift register can only be written through the serial data registers. This double
buffered operation allows a character to be shifted out serially while another character is waiting
in the serial data registers to be transferred into the shift register. The output of the shift register
is applied to TXD as long as transmission is in progress or the transmit enable (TE) bit of serial
communication control register 2 (SCCR2) is set. The block diagram, Figure 5-2, shows the
transmit serial shift register and the buffer logic at the top of the gure.
5.3
Receive operation
During receive operations, the transmit sequence is reversed. The serial shift register receives
data and transfers it to the parallel receive data registers (SCDRH/SCDRL) as a complete word.
This double buffered operation allows a character to be shifted in serially while another character
is still in the serial data registers. An advanced data recovery scheme distinguishes valid data from
noise in the serial data stream. The data input is selectively sampled to detect receive data, and
majority sampling logic determines the value and integrity of each bit.
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PDF描述 |
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