參數(shù)資料
型號： MC68HC705L16
廠商： 飛思卡爾半導體(中國)有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 59/146頁
文件大?。?/td> 772K
代理商： MC68HC705L16
MC68HC05L16 MC68HC705L16 Data Sheet, Rev. 4.1
Freescale Semiconductor
59
Chapter 7
Oscillators/Clock Distributions
7.1 Introduction
There are two oscillator blocks: OSC and XOSC. Several combinations of the clock distributions are
allowed for the modules in the MC68HC05L16. Refer to
Figure 7-1
.
Figure 7-1. Clock Signal Distribution
7.2 OSC Clock Divider and POR Counter
The OSC clock is divided by a 7-bit counter which is used for the system clock, timebase, and power-on
reset (POR) counter. Clocks divided by 2, 4, and 64 are available for the system clock selections and a
clock divided by 128 is provided for the timebase and POR counter.
The POR counter is a 6-bit clock counter that is driven by the OSC divided by 128. The overflow of this
counter is used for setting FTUP bit, releasing the POR, and resuming operation from stop mode.
The 7-bit divider and POR counter are initialized to $0078 by two conditions:
Power-on detection
When FOSCE bit is cleared
1/2
0
1/2
1
1/2
5
XOSC1
XOSC2
STOP
OSC1
OSC2
SYS1
SYS0
SEL
1/2
OSC DIVIDER
7-BIT
OSC
XOSC
CLK
CTRL
POR
6-BIT
TIMEBASE
TIMER 2
TIMER 1
SSPI
CPU
L
WAIT
EXCLK
1/2
7
1/2
7
XCLK
FOSCE/
PWRON
SYSTEM
CLOCK
FTUP
相關PDF資料
PDF描述
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