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參數(shù)資料
| 型號： | MC68HC705E5P |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP28 |
| 封裝： | PLASTIC, DIP-28 |
| 文件頁數(shù)： | 130/148頁 |
| 文件大?。?/td> | 3554K |
| 代理商： | MC68HC705E5P |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁當前第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁
NON-DISCLOSURE
AGREEMENT
REQUIRED
Motorola Bus (M Bus) Interface
General Release Specification
MC68HC705E5 — Rev. 1.0
Motorola Bus (M Bus) Interface
11.6.3 M-Bus Control Register
The M-bus control register (MCR) provides five control bits and is
cleared upon reset.
MEN — M-Bus Enable Bit
If MEN is set, the M-bus interface system is enabled. If MEN is
cleared, the interface is reset and disabled. The MEN bit must be set
first before any bits of MCR are set.
MIEN — M-Bus Interrupt Enable Bit
If MIEN is set, an interrupt occurs provided the MIF flag in the status
register is set and the I bit in the condition code register is cleared. If
MIEN is cleared, the M-bus interrupt is disabled.
MSTA — Master/Slave Mode Select Bit
Upon reset, this bit is cleared. When this bit is changed from a logic 0
to a logic 1, a start signal is generated on the bus, and master mode
is selected. When this bit is changed from a logic 1 to a logic 0, a stop
signal is generated and the operating mode changes from master to
slave.
In master mode, a bit clear immediately followed by a bit set
generates a repeated start signal (see Figure 11-1) without
generating a stop signal.
1 = Master
0 = Slave
Address:
$001A
Bit 7
654321
Bit 0
Read:
MEN
MIEN
MSTA
MTX
TXAK
MMUX
Write:
Reset:
000000
—
= Unimplemented
Figure 11-6. M-Bus Control Register (MCR)
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC705F32CPU | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP100 |
| MC68HC705F32CFU | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| MC68HC705F32FU | 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| MC68HC05F32CFU | 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PQFP80 |
| MC68HC705H12 | 8-BIT, EEPROM, 2 MHz, MICROCONTROLLER, PQCC52 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC705E6CDW | 制造商:Motorola Inc 功能描述: 制造商:MOTOROLA 功能描述: |
| MC68HC705G1B | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MC68HC705J1A | 制造商:Freescale Semiconductor 功能描述: |
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| MC68HC705J1ACP | 功能描述:IC MCU 4MHZ 1.2K OTP 20-DIP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:HC05 其它有關文件:STM32F101T8 View All Specifications 特色產(chǎn)品:STM32 32-bit Cortex MCUs 標準包裝:490 系列:STM32 F1 核心處理器:ARM? Cortex?-M3 芯體尺寸:32-位 速度:36MHz 連通性:I²C，IrDA，LIN，SPI，UART/USART 外圍設備:DMA，PDR，POR，PVD，PWM，溫度傳感器，WDT 輸入/輸出數(shù):26 程序存儲器容量:64KB（64K x 8） 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:10K x 8 電壓 - 電源 (Vcc/Vdd):2 V ~ 3.6 V 數(shù)據(jù)轉換器:A/D 10x12b 振蕩器型:內部 工作溫度:-40°C ~ 85°C 封裝/外殼:36-VFQFN，36-VFQFPN 包裝:托盤 配用:497-10030-ND - STARTER KIT FOR STM32497-8853-ND - BOARD DEMO STM32 UNIV USB-UUSCIKSDKSTM32-PL-ND - KIT IAR KICKSTART STM32 CORTEXM3497-8512-ND - KIT STARTER FOR STM32F10XE MCU497-8505-ND - KIT STARTER FOR STM32F10XE MCU497-8304-ND - KIT STM32 MOTOR DRIVER BLDC497-6438-ND - BOARD EVALUTION FOR STM32 512K497-6289-ND - KIT PERFORMANCE STICK FOR STM32MCBSTM32UME-ND - BOARD EVAL MCBSTM32 + ULINK-MEMCBSTM32U-ND - BOARD EVAL MCBSTM32 + ULINK2更多... 其它名稱:497-9032STM32F101T8U6-ND |
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