參數(shù)資料
型號： MC68HC705BS8FB
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 2.2 MHz, MICROCONTROLLER, PQFP44
封裝： QFP-44
文件頁數(shù)： 20/128頁
文件大小： 752K
代理商： MC68HC705BS8FB
MOTOROLA
13-6
MC68HC05BS8
ELECTRICAL SPECIFICATIONS
13
13.7
Sync Signal Processor Timing
Table 13-5 Sync Signal Processor Timing
(VDD=5.0Vdc ±10%, VSS=0Vdc, temperature range=0 to 70°C)
PARAMETER
SYMBOL
MINIMUM
MAXIMUM
UNIT
VSYNC input sync pulse width
tVI.SP
2
1023
tCYC
VSYNC input period
tVI
15360
48127
tCYC
HSYNC input sync pulse width
tHI.SP
1.5
16
tCYC
HSYNC input period
tHI
—
128
tCYC
Line per frame
LFRAME
—
4095
LINE
VTTL output sync pulse width
tVO.SP
6tVI.SP + 6
tHO
Free-running VTTL output sync pulse width (SOUT clear)
tFVO.SP
128
tCYC
Free-running VTTL output period (SOUT clear)
tFVO
31360
tCYC
Free-running HTTL output sync pulse width (SOUT clear)
tFHO.SP
8tCYC
Free-running HTTL output period (SOUT clear)
tFHO
35
tCYC
Inserted HTTL sync pulse (INSRT cleared)
tIHI.SP
4tCYC
Inserted HTTL period error (INSRT cleared)
tIHI.ER
—1
tCYC
SAM sampling pulse width
tSAM
1tHO
VSYNC to VTTL delay (falling edge)
tVVD
—40
ns
HSYNC to HTTL delay
tHHD
—40
ns
HSYNC to VTTL delay (rising edge)
tHVD
—40
ns
CSYNC to VTTL delay
tCVD
—60
ns
CSYNC to HTTL delay
tCHD
—60
ns
Note: tHO is the HTTL output signal period.
TPG
114
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PDF描述
MC68HC05BS8FB 8-BIT, MROM, 2.2 MHz, MICROCONTROLLER, PQFP44
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MC68HC705F4FB 8-BIT, OTPROM, 1.789 MHz, MICROCONTROLLER, PQFP44
MC68HC05F4FB 8-BIT, MROM, 1.789 MHz, MICROCONTROLLER, PQFP44
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