參數(shù)資料
型號(hào)： MC68HC12BE32MFU8
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP80
封裝： QFP-80
文件頁(yè)數(shù)： 331/362頁(yè)
文件大?。?/td> 4604K
代理商： MC68HC12BE32MFU8
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Resets and Interrupts
Data Sheet
M68HC12B Family — Rev. 9.0
70
Resets and Interrupts
MOTOROLA
An interrupt that is assigned highest priority is still subject to global masking by the
I bit in the CCR or by any associated local bits. Interrupt vectors are not affected
by priority assignment. HPRIO can be written only while the I bit is set (interrupts
inhibited). Table 4-1 lists interrupt sources and vectors in default order of priority
for all devices except the MC68HC(9)12BC32. Table 4-2 lists the interrupt sources
and vectors for the MC68HC(9)12BC32.
Table 4-1. Interrupt Vector Map(1)
Vector
Address
Interrupt Source
CCR
Mask
Local Enable
HPRIO Value
to Elevate
to Highest I Bit
Register
Bit(s)
$FFFE, $FFFF
Reset
None
—
$FFFC, $FFFD
COP clock monitor fail reset
None
COPCTL
CME, FCME
—
$FFFA, $FFFB
COP failure reset
None
COP rate selected
—
$FFF8, $FFF9
Unimplemented instruction trap
None
—
$FFF6, $FFF7
SWI
None
—
$FFF4, $FFF5
XIRQ
X bit
None
—
$FFF2, $FFF3
IRQ
I bit
INTCR
IRQEN
$F2
$FFF0, $FFF1
Real-time interrupt
I bit
RTICTL
RTIE
$F0
$FFEE, $FFEF
Timer channel 0
I bit
TMSK1
C0I
$EE
$FFEC, $FFED
Timer channel 1
I bit
TMSK1
C1I
$EC
$FFEA, $FFEB
Timer channel 2
I bit
TMSK1
C2I
$EA
$FFE8, $FFE9
Timer channel 3
I bit
TMSK1
C3I
$E8
$FFE6, $FFE7
Timer channel 4
I bit
TMSK1
C4I
$E6
$FFE4, $FFE5
Timer channel 5
I bit
TMSK1
C5I
$E4
$FFE2, $FFE3
Timer channel 6
I bit
TMSK1
C6I
$E2
$FFE0, $FFE1
Timer channel 7
I bit
TMSK1
C7I
$E0
$FFDE, $FFDF
Timer overflow
I bit
TMSK2
TOI
$DE
$FFDC, $FFDD
Pulse accumulator overflow
I bit
PACTL
PAOVI
$DC
$FFDA, $FFDB
Pulse accumulator input edge
I bit
PACTL
PAI
$DA
$FFD8, $FFD9
SPI serial transfer complete
I bit
SP0CR1
SPIE
$D8
$FFD6, $FFD7
SCI 0
I bit
SC0CR2
TIE, TCIE, RIE, ILIE
$D6
$FFD4, $FFD5
Reserved
I bit
—
$D4
$FFD2, $FFD3
ATD
I bit
ATDCTL2
ASCIE
$D2
$FFD0, $FFD1
BDLC
I bit
BCR1
IE
$D0
$FF80–$FFC1
Reserved (not implemented)
I bit
—
$80–$C0
$FFC2–$FFC9
Reserved (implemented)
I bit
—
$C2–$C8
$FFCA, $FFCB
Pulse accumulator B overflow
I bit
PBCTL
PBOVI
$CA
$FFCC, $FFCD
Modulus down counter underflow
I bit
MCCTL
MCZI
$CC
$FFCE, $FFCF
Reserved (implemented)
I bit
—
$CE
1. See Table 4-2 for the MC68HC(9)12BC32 interrupt vector map.
相關(guān)PDF資料
PDF描述
MC68HC12BE32VFU 16-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP80
MC68HC912B32CFU 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP80
MC68HC16S2CPU25 16-BIT, 25.17 MHz, MICROCONTROLLER, PQFP100
MC68HC16S2CPU20 16-BIT, 20.97 MHz, MICROCONTROLLER, PQFP100
MC68HC16Z1CFV25 16-BIT, 25 MHz, MICROCONTROLLER, PQFP144
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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MC68HC16Z1CAG20 制造商:Freescale Semiconductor 功能描述:Microcontroller
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