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參數(shù)資料
| 型號(hào)： | MC68HC08AS32A |
| 廠商： | Motorola, Inc. |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 282/296頁(yè) |
| 文件大小： | 2291K |
| 代理商： | MC68HC08AS32A |
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Electrical Specifications
Data Sheet
MC68HC08AS32A — Rev. 1
282
Electrical Specifications
MOTOROLA
18.8 5.0-Vdc
±
10% Serial Peripheral Interface (SPI) Timing
Num
(1)
1. Item numbers refer to dimensions in
Figure 18-2
and
Figure 18-3
.
2. All timing is shown with respect to 30% V
DD
and 70% V
DD
, unless otherwise noted; assumes 100 pF load on all SPI pins.
3. f
BUS
= the currently active bus frequency for the microcontroller.
4. Time to data active from high-impedance state
5. With 100 pF on all SPI pins
Characteristic
(2)
Symbol
Min
Max
Unit
Operating frequency
(3)
Master
Slave
f
BUS(
M
)
f
BUS(
S
)
f
BUS
/128
dc
f
B
US
/2
f
B
US
MHz
1
Cycle time
Master
Slave
t
CYC(
M
)
t
CYC(
S
)
2
1
128
—
t
CYC
2
Enable lead time
t
LEAD
15
—
ns
3
Enable lag time
t
LAG
15
—
ns
4
Clock (SCK) high time
Master
Slave
t
W
(
SCKH
)
M
t
W
(
SCKH
)
S
100
50
—
—
ns
5
Clock (SCK) low time
Master
Slave
t
W
(
SCKL
)
M
t
W
(
SCKL
)
S
100
50
—
—
ns
6
Data setup time, inputs
Master
Slave
t
SU
(
M
)
t
SU
(
S
)
45
5
—
—
ns
7
Data hold time, inputs
Master
Slave
t
H
(
M
)
t
H
(
S
)
0
15
—
—
ns
8
Access time, slave
(4)
CPHA = 0
CPHA = 1
t
A(CP0)
t
A(CP1)
0
0
40
20
ns
9
Slave disable time, hold time to high-impedance state
t
DIS
—
25
ns
10
Enable edge lead time to data valid
(5)
Master
Slave
t
E
V
(
M
)
t
EV(
S
)
—
—
10
40
ns
11
Enable edge lead time to data invalid
Master
Slave
t
EI(
M
)
t
EI(
S
)
0
5
—
—
ns
12
Data valid
Master (before capture edge)
t
V
(
M
)
90
---
ns
13
Data hold time (outputs)
Master (after capture edge)
t
HO
(
M
)
100
---
ns
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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