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參數資料
| 型號： | MC68HC08AB16A |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low Cost HCMOS Microcontroller(低成本、8位HCMOS微控制器) |
| 中文描述： | 低成本HCMOS微控制器（低成本，8位HCMOS微控制器） |
| 文件頁數： | 352/380頁 |
| 文件大?。?/td> | 3638K |
| 代理商： | MC68HC08AB16A |
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Low-Voltage Inhibit (LVI)
Technical Data
MC68HC08AB16A
—
Rev. 2.0
352
Low-Voltage Inhibit (LVI)
MOTOROLA
21.4 Functional Description
Figure 21-1
shows the structure of the LVI module. The LVI is enabled
out of reset. The LVI module contains a bandgap reference circuit and
comparator. The LVI power bit, LVIPWRD, enables the LVI to monitor
V
DD
voltage. The LVI reset bit, LVIRSTD, enables the LVI module to
generate a reset when V
DD
falls below a voltage, LVI
TRIPF
, and remains
at or below that level for 9 or more consecutive CPU cycles. Setting the
LVI enable in stop mode bit, LVISTOP, enables the LVI to operate in stop
mode.
LVISTOP, LVIPWRD, and LVIRSTD are in the mask option register A
(MORA).
See
Section 6. Mask Options (MOR)
for details of the LVI’s
configuration bits. Once an LVI reset occurs, the MCU remains in reset
until V
DD
rises above a voltage, LVI
TRIPR
, which causes the MCU to exit
reset.
See
8.4.2.5 Low-Voltage Inhibit (LVI) Reset
for details of the
interaction between the SIM and the LVI. The output of the comparator
controls the state of the LVIOUT flag in the LVI status register (LVISR).
An LVI reset also drives the RST pin low to provide low-voltage
protection to external peripheral devices.
NOTE:
Where LVI trip falling voltage LVI
TRIPF
= V
LVII
and LVI trip rising voltage LVI
TRIPR
= V
LVII
+ H
LVI
(See
Section 23. Electrical Specifications
.)
Figure 21-1. LVI Module Block Diagram
LOW V
DD
DETECTOR
LVIPWRD
STOP INSTRUCTION
LVISTOP
LVI RESET
LVIOUT
V
DD
> LVI
Trip
= 0
V
DD
≤
LVI
Trip
= 1
FROM MORA
FROM MORA
V
DD
FROM MORA
LVIRSTD
TO LVISR
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PDF描述 |
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