參數資料
型號: MC68HC05L5FU
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: MROM, 4.2 MHz, MICROCONTROLLER, PQFP80
封裝: PLASTIC, QFP-80
文件頁數: 34/200頁
文件大?。?/td> 941K
代理商: MC68HC05L5FU
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Timer System
Timer 2
MC68HC(7)05L5 Rev. 2.0
General Release Specification
MOTOROLA
Timer System
129
NON-DISCLOSURE
AGREEMENT
REQUIRED
IL2 — Timer Input 2 Active Edge (Level) Select
The IL2 bit selects the active edge of EVI to increment the counter for
event mode (IM2 = 0) or gate enable level of EVI for gate mode
(IM2 = 1). This bit is cleared on reset.
0 = Falling edge selected (event mode)
Low level enables counting (gate mode)
1 = Rising edge selected (event mode)
High level enables counting (gate mode)
OE2 — Timer Output 2 (EVO) Output Enable
The OE2 bit enables EVO output on the PC5 pin. When this bit is
changed, control of the pin is delayed (synchronized) until the next
active edge of EVO is selected by the OL2 bit. This bit is cleared on
reset.
0 = EVO output disabled
1 = EVO output enabled
OL2 — Timer Output 2 Edge Select for Synchronization
The OL2 bit selects which edge of EVO clock should be synchronized
by the OE2 bit control. The OL2 bit also decides the initial value of the
CMP2 divider, when counter 2 is written to by the CPU. This bit is
cleared on reset.
0 = The falling edge of EVO switches EVO output and PC5 if the
OE2 bit has been changed.
1 = The rising edge of EVO switches EVO output and PC5 if the
OE2 bit has been changed.
Table 9-1. EVI Modes Selection
IM2
IL2
Action on Clock
0
Falling edge of EVI increments counter
0
1
Rising edge of EVI increments counter
1
0
Low level on EVI enables counting
1
High level on EVI enables counting
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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MC68HC705RC17DW 8-BIT, OTPROM, 2.097 MHz, MICROCONTROLLER, PDSO28
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參數描述
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