參數資料
型號： MC68F375BGMVR33R
廠商： Freescale Semiconductor
文件頁數： 158/616頁
文件大?。?/td> 0K
描述： IC MPU 32BIT 33MHZ 217-PBGA
標準包裝： 500
系列： M683xx
處理器類型： M683xx 32-位
速度： 33MHz
電壓： 5V
安裝類型： 表面貼裝
封裝/外殼： 217-BBGA
供應商設備封裝： 217-PBGA（23x23）
包裝： 帶卷 (TR)
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MC68F375
QUEUED SERIAL MULTI-CHANNEL MODULE
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
6-6
6.5.4 QSMCM Interrupts
Both the QSPI and SCI can generate interrupt requests. Each has a separate interrupt
request priority register. A single vector register is used to generate exception vector
numbers.
The values of the ILQSPI and ILSCI fields in QILR determine the priority of QSPI and
SCI interrupt requests. The values in these fields correspond to internal interrupt re-
quest signals IRQ[7:1]. A value of 0b111 causes IRQ7 to be asserted when a QSM
interrupt request is made. Lower field values cause correspondingly lower-numbered
interrupt request signals to be asserted. Setting the ILQSPI or ILSCI field values to
0b000 disables interrupts for the respective section. If ILQSPI and ILSCI have the
same non-zero value, and the QSPI and SCI make simultaneous interrupt requests,
the QSPI has priority.
When the CPU32 acknowledges an interrupt request, it places the value in the status
register interrupt priority (IP) mask on the address bus. The QSM compares the IP
mask value to the priority of the request to determine whether it should contend for ar-
bitration priority. Arbitration priority is determined by the value of the IARB field in
QSMCR. Each module that generates interrupts must have a non-zero IARB value. Ar-
bitration is performed by means of serial contention between values stored in individ-
ual module IARB fields.
When the QSM wins interrupt arbitration, it responds to the CPU32 interrupt acknowl-
edge cycle by placing an interrupt vector number on the data bus. The vector number
is used to calculate displacement into the CPU32 exception vector table. SCI and
QSPI vector numbers are generated from the value in the QIVR INTV field. The values
of bits INTV[7:1] are the same for QSPI and SCI. The value of INTV0 is supplied by
the QSM when an interrupt request is made. INTV0 = 0 for SCI interrupt requests;
INTV0 = 1 for QSPI interrupt requests.
At reset, INTV[7:0] is initialized to 0x0F, the uninitialized interrupt vector number. To
enable interrupt-driven serial communication, a user-defined vector number must be
written to QIVR, and interrupt handler routines must be located at the addresses point-
ed to by the corresponding vector. Writes to INTV0 have no effect. Reads of INTV0
return a value of one.
INTEGRATION MODULE 2 (SCIM2E) for more information about exceptions and in-
terrupts.
6.5.5 QSMCM Configuration Register (QSMCMMCR)
The QSMCMMCR contains parameters for interfacing to the CPU and the intermodule
bus. This register can be modified only when the CPU is in supervisor mode.
F
re
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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c
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相關PDF資料
PDF描述
AMC50DTES CONN EDGECARD 100POS .100 EYELET
MC68EN360ZP33L IC MPU QUICC 32BIT 33MHZ 357PBGA
HMC50DTEF CONN EDGECARD 100POS .100 EYELET
MC68EN360ZP25LR2 IC MPU QUICC 32BIT 25MHZ 357PBGA
AMC36DTEF CONN EDGECARD 72POS .100 EYELET
相關代理商/技術參數
參數描述
MC68F375BGMZP33 功能描述:32位微控制器 - MCU 32B 256KFLASH 8K 2K RAM RoHS:否 制造商:Texas Instruments 核心:C28x 處理器系列:TMS320F28x 數據總線寬度:32 bit 最大時鐘頻率:90 MHz 程序存儲器大小:64 KB 數據 RAM 大小:26 KB 片上 ADC:Yes 工作電源電壓:2.97 V to 3.63 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:LQFP-80 安裝風格:SMD/SMT
MC68F375MZP33R2 功能描述:IC MPU 32BIT 33MHZ 217-PBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點:- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應商設備封裝:783-FCPBGA（29x29） 包裝:托盤
MC68H(R)C08JK1 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit
MC68H(R)C08JK3 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit
MC68H(R)C08JL3 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit
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