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參數(shù)資料
| 型號： | MC68332ACAG25 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 68/88頁 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 25MHZ 144-LQFP |
| 標準包裝： | 60 |
| 系列： | M683xx |
| 核心處理器： | CPU32 |
| 芯體尺寸： | 32-位 |
| 速度： | 25MHz |
| 連通性： | EBI/EMI，SCI，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 15 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-LQFP |
| 包裝： | 托盤 |
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MOTOROLA
MC68332
70
MC68332TS/D
NOTES:
1. PQS2 is a digital I/O pin unless the SPI is enabled (SPE in SPCR1 set), in which case it becomes SPI
serial clock SCK.
2. PQS7 is a digital I/O pin unless the SCI transmitter is enabled (TE in SCCR1 = 1), in which case it be-
comes SCI serial output TXD.
DDRQS determines the direction of the TXD pin only when the SCI transmitter is disabled. When the
SCI transmitter is enabled, the TXD pin is an output.
Table 26 Effect of DDRQS on QSM Pin Function
QSM Pin
Mode
DDRQS
Bit
State
Pin Function
MISO
Master
DDQ0
0
Serial Data Input to QSPI
1
Disables Data Input
Slave
0
Disables Data Output
1
Serial Data Output from QSPI
MOSI
Master
DDQ1
0
Disables Data Output
1
Serial Data Output from QSPI
Slave
0
Serial Data Input to QSPI
1
Disables Data Input
SCK1
Master
DDQ2
0
Disables Clock Output
1
Clock Output from QSPI
Slave
0
Clock Input to QSPI
1
Disables Clock Input
PCS0/SS
Master
DDQ3
0
Assertion Causes Mode Fault
1
Chip-Select Output
Slave
0
QSPI Slave Select Input
1
Disables Select Input
PCS[3:1]
Master
DDQ[4:6]
0
Disables Chip-Select Output
1
Chip-Select Output
Slave
0
Inactive
1
Inactive
TXD2
Transmit
DDQ7
X
Serial Data Output from SCI
RXD
Receive
None
NA
Serial Data Input to SCI
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| MC68332ACEH16 | 制造商:Freescale Semiconductor 功能描述:32-Bit Microcontroller IC |
| MC68332ACEH16B1 | 制造商:Freescale Semiconductor 功能描述: |
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