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參數資料
| 型號： | MC56F8345VFGE |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 63/172頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP 16BIT 60MHZ 128-LQFP |
| 標準包裝： | 72 |
| 系列： | 56F8xxx |
| 核心處理器： | 56800E |
| 芯體尺寸： | 16-位 |
| 速度： | 60MHz |
| 連通性： | CAN，EBI/EMI，SCI，SPI |
| 外圍設備： | POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數： | 49 |
| 程序存儲器容量： | 136KB（68K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 6K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.25 V ~ 3.6 V |
| 數據轉換器： | A/D 16x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 128-LQFP |
| 包裝： | 托盤 |
| 配用： | MC56F8367EVME-ND - EVAL BOARD FOR MC56F83X |
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Equivalent Circuit for ADC Inputs
56F8345 Technical Data, Rev. 17
Freescale Semiconductor
155
Preliminary
10.16 Equivalent Circuit for ADC Inputs
Figure 10-22 illustrates the ADC input circuit during sample and hold. S1 and S2 are always open/closed
at the same time that S3 is closed/open. When S1/S2 are closed & S3 is open, one input of the sample and
hold circuit moves to VREFH - VREFH / 2, while the other charges to the analog input voltage. When the
switches are flipped, the charge on C1 and C2 are averaged via S3, with the result that a single-ended
analog input is switched to a differential voltage centered about VREFH - VREFH / 2. The switches switch
on every cycle of the ADC clock (open one-half ADC clock, closed one-half ADC clock). Note that there
are additional capacitances associated with the analog input pad, routing, etc., but these do not filter into
the S/H output voltage, as S1 provides isolation during the charge-sharing phase.
One aspect of this circuit is that there is an on-going input current, which is a function of the analog input
voltage, VREF and the ADC clock frequency.
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