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參數(shù)資料
型號： MC56F8345VFGE
廠商： Freescale Semiconductor
文件頁數(shù)： 18/172頁
文件大?。?/td> 0K
描述： IC DSP 16BIT 60MHZ 128-LQFP
標(biāo)準(zhǔn)包裝： 72
系列： 56F8xxx
核心處理器： 56800E
芯體尺寸： 16-位
速度： 60MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 49
程序存儲器容量： 136KB（68K x 16）
程序存儲器類型： 閃存
RAM 容量： 6K x 16
電壓 - 電源 (Vcc/Vdd)： 2.25 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b
振蕩器型： 外部
工作溫度： -40°C ~ 105°C
封裝/外殼： 128-LQFP
包裝： 托盤
配用： MC56F8367EVME-ND - EVAL BOARD FOR MC56F83X
56F8345 Technical Data, Rev. 17
114
Freescale Semiconductor
Preliminary
Figure 6-10 Overall Control of Pads Using SIM_GPS Control
Table 6-2 Control of Pads Using SIM_GPS Control 1
1. This applies to the four pins that serve as Quad Decoder / Quad Timer / SPI / GPIOC functions. A separate set of control
bits is used for each pin.
Pin Function
Control Registers
Comments
GPIOC_PER
GPI
O
C_DT
R
SIM_GPS
Qu
ad
T
imer
SCR
Registe
r
OE
N
bi
ts
GPIO Input
0
—
GPIO Output
0
1
—
Quad Timer Input /
Quad Decoder
Input 2
2. Reset configuration
1
—
0
See the “Switch Matrix for Inputs to the Timer”
table in the 56F8300 Peripheral User Manual
for the definition of timer inputs based on the
Quad Decoder mode configuration.
Quad Timer
Output / Quad
Decoder Input 3
3. Quad Decoder pins are always inputs and function in conjunction with the Quad Timer pins.
1—
0
1
SPI input
1
—
1
—
See SPI controls for determining the direction
of each of the SPI pins.
SPI output
1
—
1
—
GPIOC_PER Register
GPIO Controlled
I/O Pad Control
SIM_ GPS Register
Quad Timer Controlled
SPI Controlled
0
1
0
1
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