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參數(shù)資料
| 型號(hào)： | MC3S12P128J0CLHR |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 1.05 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, MS-026BCD, LQFP-64 |
| 文件頁(yè)數(shù)： | 211/566頁(yè) |
| 文件大小： | 7046K |
| 代理商： | MC3S12P128J0CLHR |
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Freescale’s Scalable Controller Area Network (S12MSCANV3)
S12P-Family Reference Manual, Rev. 1.13
Freescale Semiconductor
289
message in its RxBG (wrong identier, transmission errors, etc.) the actual contents of the buffer will be
over-written by the next message. The buffer will then not be shifted into the FIFO.
When the MSCAN module is transmitting, the MSCAN receives its own transmitted messages into the
background receive buffer, RxBG, but does not shift it into the receiver FIFO, generate a receive interrupt,
or acknowledge its own messages on the CAN bus. The exception to this rule is in loopback mode (see
Section 8.3.2.2, “MSCAN Control Register 1 (CANCTL1)”) where the MSCAN treats its own messages
exactly like all other incoming messages. The MSCAN receives its own transmitted messages in the event
that it loses arbitration. If arbitration is lost, the MSCAN must be prepared to become a receiver.
An overrun condition occurs when all receive message buffers in the FIFO are lled with correctly
received messages with accepted identiers and another message is correctly received from the CAN bus
with an accepted identier. The latter message is discarded and an error interrupt with overrun indication
is generated if enabled (see Section 8.4.7.5, “Error Interrupt”). The MSCAN remains able to transmit
messages while the receiver FIFO being lled, but all incoming messages are discarded. As soon as a
receive buffer in the FIFO is available again, new valid messages will be accepted.
8.4.3
Identier Acceptance Filter
The MSCAN identier acceptance registers (see Section 8.3.2.12, “MSCAN Identier Acceptance
Control Register (CANIDAC)”) dene the acceptable patterns of the standard or extended identier
(ID[10:0] or ID[28:0]). Any of these bits can be marked ‘don’t care’ in the MSCAN identier mask
A lter hit is indicated to the application software by a set receive buffer full ag (RXF = 1) and three bits
in the CANIDAC register (see Section 8.3.2.12, “MSCAN Identier Acceptance Control Register
(CANIDAC)”). These identier hit ags (IDHIT[2:0]) clearly identify the lter section that caused the
acceptance. They simplify the application software’s task to identify the cause of the receiver interrupt. If
more than one hit occurs (two or more lters match), the lower hit has priority.
A very exible programmable generic identier acceptance lter has been introduced to reduce the CPU
interrupt loading. The lter is programmable to operate in four different modes (see Bosch CAN 2.0A/B
protocol specication):
Two identier acceptance lters, each to be applied to:
— The full 29 bits of the extended identier and to the following bits of the CAN 2.0B frame:
– Remote transmission request (RTR)
– Identier extension (IDE)
– Substitute remote request (SRR)
— The 11 bits of the standard identier plus the RTR and IDE bits of the CAN 2.0A/B messages1.
This mode implements two lters for a full length CAN 2.0B compliant extended identier.
Figure 8-40 shows how the rst 32-bit lter bank (CANIDAR0–CANIDAR3,
CANIDMR0–CANIDMR3) produces a lter 0 hit. Similarly, the second lter bank
(CANIDAR4–CANIDAR7, CANIDMR4–CANIDMR7) produces a lter 1 hit.
Four identier acceptance lters, each to be applied to
1. Although this mode can be used for standard identifiers, it is recommended to use the four or eight identifier acceptance
filters for standard identifiers
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