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參數(shù)資料
| 型號： | MC33989 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | CAN |
| 英文描述： | System Basis Chip with High Speed CAN Transceiver(帶高速CAN收發(fā)器的系統(tǒng)基片) |
| 中文描述： | 系統(tǒng)基礎(chǔ)芯片的高速CAN收發(fā)器（帶高速的CAN收發(fā)器的系統(tǒng)基片） |
| 文件頁數(shù)： | 28/32頁 |
| 文件大?。?/td> | 676K |
| 代理商： | MC33989 |
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28
MC33989
MC33989
refer to chapter 4.9.2 for detail of the LPC register set up required for proper cyclic sense or direct wake up operation.
7.1.10
INTR register
Description: This register allows to mask or enable the INT source. A read operation informs about the interrupt source.
Control bits:
When the mask bit has been set, INTB pin goes low if the appropriate condition occurs.
Status bits:
Notes:
LX2HS1
Wake-up inputs supplied by HS1
0
no
1
yes, Lx inputs sensed at sampling point
HS1AUTO
Autotiming HS1 in sleep and stop modes
0
off
1
on, HS1 cyclic, period defined in TIM2 register
INTR
D3
D2
D1
D0
$111b
W
VSUPLOW
HS1OT-V2LOW
VDDTEMP
CANF
R
VSUPLOW
HS1OT
VDDTEMP
CANF
Reset value
0
0
0
0
Reset condition
POR, RESET
POR, RESET
POR, RESET
POR, RESET
Control bit
Description
CANF
Mask bit for CAN failures
VDDTEMP
Mask bit for VDD medium temperature (pre warning)
HS1OT-V2LOW
Mask bit for HS1 over temperature AND V2 below 4V
VSUPLOW
Mask bit for Vsup below 6.1V
Status bit
Description
CANF
CAN failure
VDDTEMP
VDD medium temperature (pre warning)
HS1OT
HS1 over temperature
VSUPLOW
Vsup below 6.1V
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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