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參數(shù)資料
| 型號(hào)： | MB90947APF |
| 廠商： | FUJITSU LTD |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 3.35 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 44/72頁(yè) |
| 文件大?。?/td> | 1586K |
| 代理商： | MB90947APF |
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MB90945 Series
DS07-13741-3E
49
(5) UART2/3 Timing
Bit setting : ESCR : SCES
= 0, ECCR : SCDE = 0
(TA
= 40 °C to +105 °C, VCC = 3.5V to 5.5 V, VSS = AVSS = 0V)
Note : tCP is the machine clock cycle time (Unit : ns) . Refer to “ (1) Clock timing” rating for tCP.
Parameter
Sym-
bol
Pin
Condition
Value
Unit Remarks
Min
Max
Serial clock cycle time
tSCYC
SCK2,SCK3
Internal clock
operation output
pins are
CL
= 80 pF + 1 TTL.
5 tCP
ns
SCK
↓ → SOT delay time
tSLOVI
SCK2,SCK3
SOT2,SOT3
50
+50
ns
Valid SIN
→ SCK ↑
tIVSHI
SCK2,SCK3
SIN2,SIN3
tCP
+ 80
ns
SCK
↑ → Valid SIN hold time
tSHIXI
SCK2,SCK3
SIN2,SIN3
0
ns
Serial clock “H” pulse width
tSHSL
SCK2,SCK3
External clock
operation output
pins are
CL
= 80 pF + 1 TTL.
tCP
+ 10
ns
Serial clock “L” pulse width
tSLSH
SCK2,SCK3
3 tCP
tR
ns
SCK
↓ → SOT delay time
tSLOVE
SCK2,SCK3
SOT2,SOT3
2 tCP
+ 60 ns
Valid SIN
→ SCK ↑
tIVSHE
SCK2,SCK3
SIN2,SIN3
30
ns
SCK
↑ → Valid SIN hold time tSHIXE
SCK2,SCK3
SIN2,SIN3
tCP
+ 30
ns
SCK fall time
tF
SCK2,SCK3
10
ns
SCK rise time
tR
SCK2,SCK3
10
ns
SCK
2.4 V
0.8 V
SOT
0.8 V
2.4 V
0.8 V
tSLOVI
SIN
VIL
VIH
VIL
VIH
tSCYC
tIVSHI
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