參數(shù)資料
型號： MAXQ7670ATL+T
廠商： Maxim Integrated Products
文件頁數(shù)： 36/38頁
文件大小： 0K
描述： IC MCU W/10BIT ADC 40TQFN-EP
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 2,500
系列： MAXQ®
核心處理器： RISC
芯體尺寸： 16-位
速度： 16MHz
連通性： CAN，SPI
外圍設(shè)備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 7
程序存儲器容量： 64KB（32K x 16）
程序存儲器類型： 閃存
RAM 容量： 1K x 16
電壓 - 電源 (Vcc/Vdd)： 2.25 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 40-WFQFN 裸露焊盤
包裝： 帶卷 (TR)
MAXQ7670
Microcontroller with 10-Bit ADC,
PGA, 64KB Flash, and CAN Interface
_______________________________________________________________________________________
7
ELECTRICAL CHARACTERISTICS (continued)
(VDVDDIO = +5.0V, VAVDD = +3.3V, VDVDD = +2.5V, VREFADC = +3.3V, system clock = 16MHz. TA = TMIN to TMAX, unless otherwise
noted. Typical values are at TA = +25°C.) (Note 1)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Output Capacitance
I/O pins three-state
15
pF
PD0._ = 0
880
Maximum Output Impedance
PD0._ = 1
450
SYSTEM CLOCK
System Clock Frequency
fSYSCLK
From any clock source
0
16.67
MHz
SPI INTERFACE TIMING
SPI Master Operating
Frequency
fMCLK
0.5 x fSYSCLK
8
MHz
SPI Slave Mode Operating
Frequency
fSCLK
fSYSCLK/8
MHz
SCLK Output Pulse-Width
High/Low
tMCH,
tMCL
tSYSCLK
- 25
ns
SCLK Input Pulse-Width
High/Low
tSCH, tSCL
tSYSCLK
ns
MOSI Output Hold Time
After SCLK Sample Edge
tMOH
tSYSCLK
- 25
ns
MOSI Output Setup Time to
SCLK Sample Edge
tMOS
tSYSCLK
- 25
ns
MISO Input Setup Time to
SCLK Sample Edge
tMIS
30
ns
MISO Input Hold Time After
SCLK Sample Edge
tMIH
0ns
SCLK Inactive to MOSI
Inactive
tMLH
tSYSCLK
- 25
ns
MOSI Input Setup Time to
SCLK Sample Edge
tSIS
30
ns
MOSI Input Hold Time After
SCLK Sample Edge
tSIH
tSYSCLK
+ 25
ns
MISO Output Valid After
SCLK Shift Edge Transition
tSOV
3 tSYSCLK
+ 25
ns
MISO Output Disabled After
SS Edge Rise
tSLH
2 tSYSCLK
+ 50
ns
SS Falling Edge to MISO Active
tSOE
2 tSYSCLK
+ 2.5
ns
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PDF描述
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