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參數(shù)資料
| 型號： | MAX9489ETJ |
| 廠商： | MAXIM INTEGRATED PRODUCTS INC |
| 元件分類： | XO, clock |
| 英文描述： | Multiple-Output Network Clock Generator |
| 中文描述： | 133 MHz, OTHER CLOCK GENERATOR, QCC32 |
| 封裝： | 5 X 5 MM, 0.80 MM PITCH, TQFN-32 |
| 文件頁數(shù)： | 4/11頁 |
| 文件大?。?/td> | 176K |
| 代理商： | MAX9489ETJ |
M
Multiple-Output Network Clock Generator
4
_______________________________________________________________________________________
Note 1:
All DC parameters tested at T
A
= +25°C. Specifications over temperature are guaranteed by design.
Note 2:
Guaranteed by design.
Note 3:
No high output level is specified but only the output resistance to the bus. For I
2
C, the high-level voltage is provided by
pullup resistors on the bus.
Note 4:
A master device must provide a hold time of at least 300ns for the SDA signal (referred to V
IL
of the SCL signal) to bridge
the undefined region of SCL’s falling edge.
Note 5:
C
b
= total capacitance of one bus line in pF. t
R
and t
F
measured between 0.3(V
DD
) and 0.7(V
DD
).
Note 6:
Input filters on the SDA and SCL inputs suppress noise spikes less than 50ns.
SERIAL INTERFACE TIMING
(V
DD
= AV
DD
= +3.3V, T
A
= -40°C to +85°C.) (Note 1, Figure 2)
PARAMETER
SYMBOL
f
SCL
CONDITIONS
MIN
TYP
MAX
400
UNITS
kHz
Serial Clock
Bus Free Time Between STOP
and START Conditions
t
BUF
1.3
μs
Hold Time, Repeated START
Condition
t
HD,STA
0.6
μs
Repeated START Condition
Setup Time
t
SU,STA
0.6
μs
STOP Condition Setup Time
Data Hold Time Master
Data Hold Time Slave
Data Setup Time
SCL Clock Low Period
SCL Clock High Period
t
SU,STO
t
HD,DAT
t
HD,DAT
t
SU,DAT
t
LOW
t
HIGH
0.6
15
15
100
1.3
0.7
μs
ns
ns
ns
μs
μs
(Note 4)
(Note 4)
900
900
Rise Time of SDA and SCL,
Receiving
t
R
(Notes 2, 5)
20 +
0.1C
b
300
ns
Fall Time of SDA and SCL,
Receiving
t
F
(Notes 2, 5)
20 +
0.1C
b
300
ns
Fall Time of SDA, Transmitting
t
F,TX
(Notes 2, 5)
20 +
0.1C
b
0
250
ns
Pulse Width of Spike Suppressed
t
SP
(Notes 2, 6)
50
ns
Capacitive Load for Each Bus
Line
C
b
(Note 2)
400
pF
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MAX9491ETP | Factory-Programmable, Single PLL Clock Generator |
| MAX9491EUD | Factory-Programmable, Single PLL Clock Generator |
| MAX9491 | Factory-Programmable, Single PLL Clock Generator |
| MAX9492 | Multiple-Output Clock Generator with Spread Spectrum |
| MAX9492ETP | Multiple-Output Clock Generator with Spread Spectrum |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MAX9491ETP010+ | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Factory-Prog Single PLL Clock Generator RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MAX9491ETP010+T | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Factory-Prog Single PLL Clock Generator RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MAX9491ETP010-T | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MAX9491ETP045 | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
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