參數(shù)資料
型號(hào)： MAX3638ETM+
廠商： MAXIM INTEGRATED PRODUCTS INC
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 800 MHz, OTHER CLOCK GENERATOR, QCC48
封裝： 7 X 7 MM, 0.80 MM HEIGHT, ROHS COMPLIANT, TQFN-48
文件頁(yè)數(shù)： 2/22頁(yè)
文件大?。?/td> 2523K
代理商： MAX3638ETM+
Low-Jitter, Wide Frequency Range,
Programmable Clock Generator with 10 Outputs
MAX3638
10
Detailed Description
The MAX3638 is a low-jitter clock generator designed to
operate over a wide range of frequencies. It consists of
a selectable reference clock (on-chip crystal oscillator,
LVCMOS input, or differential input), PLL with on-chip
VCO, pin-programmable dividers and muxes, and three
banks of clock outputs. See Figure 2. The output banks
include nine pin-programmable LVDS/LVPECL output
buffers and one LVCMOS output buffer. The frequency,
enabling, and output interface of each output bank can
be individually programmed. In addition the A-bank is
split into two banks with programmable enabling and
Figure 2. Detailed Functional Diagram
MAX3638
QA1
QA2
QA3
QA0
QA_CTRL1
VCCQA
VCCQCC
VCCQC
DC[1:0]
VCCA
PLL_BP
DA[1:0]
2
QA0
QB1
QB2
QB0
QCC
QC
QA4
QA_CTRL2
VCCQB
QB_CTRL
VCO
LVCMOS
÷M
fREF
fVCO
fQA
0
NC
1
DIN
CIN
XIN
XOUT
LVPECL
IN_SEL
1
0/NC
CRYSTAL
OSCILLATOR
÷P
÷A
÷B
÷C
PFD
fQB
1
0/NC
CP
2
DB[1:0]
2
DF[1:0]
2
DP
3830MHz TO 4025MHz
fPFD
15MHz TO 42MHz
VCC
DM
QC_CTRL
fQC
0
1/NC
÷F
EP
DIVIDER A: 2, 3, 4, 5, 6, 8, 10, 12, 15
DIVIDER B: 2, 3, 4, 5, 6, 8, 10, 12, 15
DIVIDER C: 3, 5, 6, 8, 10, 12, 15, 20, 30
DIVIDER F: 16, 20, 24, 25, 28, 30, 32, 40, 48
DIVIDER M: 1, 2, 4
DIVIDER P: 4, 5, 6
相關(guān)PDF資料
PDF描述
MAX3679CTJ+ 625 MHz, OTHER CLOCK GENERATOR, QCC32
MAX7329AUP+ 8 I/O, PIA-GENERAL PURPOSE, PDSO20
MAX7329AAP+ 8 I/O, PIA-GENERAL PURPOSE, PDSO20
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MAXQ613E-0000+ 16-BIT, FLASH, 12 MHz, RISC MICROCONTROLLER, PQFP32
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參數(shù)描述
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