參數(shù)資料
型號(hào): M38037M8H-XXXWG
元件分類(lèi): 微控制器/微處理器
英文描述: 8-BIT, MROM, 8.4 MHz, MICROCONTROLLER, PBGA64
封裝: 6 X 6 MM, 0.65 MM PITCH, PLASTIC, FLGA-64
文件頁(yè)數(shù): 4/111頁(yè)
文件大?。?/td> 1205K
代理商: M38037M8H-XXXWG
Rev.3.02
Nov 05, 2004
page 101 of 108
3803 Group (Spec. H)
PRELIMINARY
Notice: This is not a final specification.
Some parametric limits are subject to change.
Note : When bit 6 of address 001A16 and bit 6 of address 003216 are “1” (clock synchronous).
Divide this value by four when bit 6 of address 001A16 and bit 6 of address 003216 are “0” (UART).
Table 34 Timing requirements (2)
(Mask ROM version: VCC = 2.0 to 5.5 V, VSS = 0V, Ta = –20 to 85 °C, unless otherwise noted)
(Flash memory version: VCC = 2.7 to 5.5 V, VSS = 0V, Ta = –20 to 85 °C, unless otherwise noted)
Limits
ns
Parameter
Max.
Symbol
Unit
Typ.
Min.
250
320
500
1000
2000
120
150
240
480
950
120
150
240
480
950
70
90
100
200
400
32
40
50
100
200
500
650
1000
2000
4000
200
260
400
950
2000
200
260
400
950
2000
100
130
200
400
800
100
130
150
300
600
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
4.5
≤VCC≤5.5 V
4.0
≤VCC<4.5 V
2.7
≤VCC<4.0 V
2.2
≤VCC<2.7 V
2.0
≤VCC<2.2 V
Serial I/O1, serial I/O3
clock input cycle time (Note)
Serial I/O1, serial I/O3
clock input “H” pulse width (Note)
Serial I/O1, serial I/O3
clock input “L” pulse width (Note)
Serial I/O1, serial I/O3
clock input setup time
Serial I/O1, serial I/O3
clock input hold time
Serial I/O2
clock input cycle time
Serial I/O2
clock input “H” pulse width
Serial I/O2
clock input “L” pulse width
Serial I/O2
clock input setup time
Serial I/O2
clock input hold time
tC(SCLK1), tC(SCLK3)
tWH(SCLK1), tWH(SCLK3)
tWL(SCLK1), tWL(SCLK3)
tsu(RxD1-SCLK1),
tsu(RxD3-SCLK3)
th(SCLK1-RxD1),
th(SCLK3-RxD3)
tC(SCLK2)
tWH(SCLK2)
tWL(SCLK2)
tsu(SIN2-SCLK2)
th(SCLK2-SIN2)
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