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參數(shù)資料
| 型號： | M32170F4VFG |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | 32-BIT RISC SINGLE-CHIP MICROCOMPUTER |
| 中文描述： | 32位RISC單片機 |
| 文件頁數(shù)： | 540/850頁 |
| 文件大小： | 3274K |
| 代理商： | M32170F4VFG |
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11
11-42
Ver.0.10
11.3.2 A-D Conversion by Successive Approximation Method
The A-D converter has A-D convert operation started by an A-D conversion start trigger (in software
or hardware). Once A-D conversion begins, the following operation is automatically executed.
During single mode, Single Mode Register 0's A-D conversion/comparate completion bit is
cleared to 0. During scan mode, Can Mode Register 0's A-D conversion completion bit is
cleared to 0.
The content of the A-D Successive Approximation Register is cleared to "H'0000."
The A-D Successive Approximation Register's most significant bit (D6) is set to 1.
The comparison voltage, Vref(note), is fed from the D-A converter into the comparator.
The comparison voltage, Vref, and the analog input voltage, VIN, are compared, with the
comparison result stored in D6.
If Vref < VIN, then D6 = 1
If Vref > VIN, then D6 = 0
Operations in steps
through
above are executed for all other bits from D7 to D15.
The value stored in the A-D Successive Approximation Register at completion of the
comparison of D15 is the final A-D conversion result.
Figure 11.3.2 Changes of the A-D Successive Approximation Register during A-D Convert Operation
Note:
The comparison voltage, Vref (the voltage fed from the D-A converter into the comparator), is
determined according to changes of the content of the A-D Successive Approximation Register. Shown
below are the equations used to calculate the comparison voltage, Vref.
When the content of the A-D Successive Approximation Register = 0
Vref [V] = 0
When the content of the A-D Successive Approximation Register = 1 to 1,023
Vref [V] = (reference voltage VREF / 1,024) x (content of the A-D Successive Approximation Register - 0.5)
A-D CONVERTERS
11.3 Functional Description of A-D Converters
1st comparison
D6
7
8
9
10
11
12
13
14
D15
1
0
0
0
0
0
0
0
0
0
n9
1
0
0
0
0
0
0
0
0
n9
n8
1
0
0
0
0
0
0
0
n9
n8
n7
n6
n5
n4
n3
n2
n1
1
2nd comparison
3rd comparison
10th comparison
Conversion
completed
n9
n8
n7
n6
n5
n4
n3
n2
n1
n0
Result of 1st comparison
Result of 2nd comparison
Vref > VIN then nX=0
Vref < VIN then nX=1
A-D Successive Approximation Register (ADiSAR) i=0,1
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| M32170F4VWG | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER |
| M32170F6VFP | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER |
| M32170F6VWG | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:SINGLE-CHIP 32-BIT CMOS MICROCOMPUTER |
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