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參數(shù)資料
| 型號(hào)： | LPC47N227TQFP |
| 廠商： | STANDARD MICROSYSTEMS CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | 100 Pin Super I/O with LPC Interface for Notebook Applications |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數(shù)： | 171/228頁 |
| 文件大?。?/td> | 1269K |
| 代理商： | LPC47N227TQFP |
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SMSC DS – LPC47M192
Page 171
Rev. 03/30/05
DATASHEET
REGISTER
Power Mgmt
Default = 0x00
on VCC POR,
VTR POR and
PCI RESET
ADDRESS
0x23 R/W
DESCRIPTION
Bit[0] FDC (See Note in the “FDC Power
Management” section)
Bit[1] Reserved
Bit[2] Reserved
Bit[3] Parallel Port
Bit[4] Serial Port 1
Bit[5] Serial Port 2
Bit[6] MPU-401
Bit[7] Reserved (read as 0)
For each bit above (except Reserved)
= 0 Intelligent Pwr Mgmt off
= 1 ntelligent Pwr Mgmt on
Bit[0] Reserved
Bit [1] PLL Control
= 0 PLL is on (backward Compatible)
= 1 PLL is off
Bits[3:2] OSC
= 01 Osc is on, BRG clock is on.
= 10 Same as above (01) case.
= 00 Osc is on, BRG Clock Enabled.
= 11 Osc is off, BRG clock is disabled.
Bit [5:4] Reserved, set to zero
Bit [6] 16-Bit Address Qualification
= 0 12-Bit Address Qualification
= 1 16-Bit Address Qualification
Note
: For normal operation, bit 6 should be set.
Bit[7] Reserved
Reserved - Writes are ignored, reads return 0.
OSC
Default = 0x44, on
on VCC POR,
VTR POR and
PCI RESET
0x24 R/W
Chip Level
Vendor Defined
Configuration
Address Byte 0
Default
=0x2E (Sysopt=0)
=0x4E (Sysopt=1)
on VCC POR and
PCI RESET
Configuration
Address Byte 1
Default = 0x00
on VCC POR and
PCI RESET
Default = 0x00
on VCC POR,
SOFT RESET and
PCI RESET
Chip Level
Vendor Defined
0x25
0x26
Bit[7:1] Configuration Address Bits [7:1]
Bit[0] = 0
See Note 1
0x27
Bit[7:0] Configuration Address Bits [15:8]
See Note 1
0x28
Bits[7:0] Reserved - Writes are ignored, reads return
0.
0x29
Reserved - Writes are ignored, reads return 0.
相關(guān)PDF資料 |
PDF描述 |
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