參數(shù)資料
型號(hào)： LPC47N227MN
英文描述： Peripheral IC
中文描述： 外圍芯片
文件頁(yè)數(shù)： 176/228頁(yè)
文件大小： 1269K
代理商： LPC47N227MN
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SMSC DS – LPC47M192
Page 176
Rev. 03/30/05
DATASHEET
Table 67 – I/O Base Address Configuration Register Description
LOGICAL
DEVICE
INDEX
(Note 1)
Runtime
Register
Block
LOGICAL
DEVICE
NUMBER
0x0A
REGISTER
BASE I/O
RANGE
FIXED
BASE OFFSETS
0x60,0x61
[0x0000:0x0F7F]
on 128-byte boundaries
+00 : PME Status
.
.
.
+5F : Keyboard Scan Code
(See Table in “Runtime Registers” section
for Full List)
+0: MIDI DATA
+1: STATUS/COMMAND
See Configuration Register in Table 64.
Accessed through the index and DATA
ports located at the Configuration Port
address and the Configuration Port
address +1 respectively.
0x0B
MPU-401
Config. Port
0x60,0x61
[0x0100:0x0FFE]
on 2-byte boundaries
0x0100:0x0FFE
On 2 byte boundaries
Config.
Port
0x26, 0x27
(Note 2)
Note 1
: This chip uses address bits [A11:A0] to decode the base address of each of its logical devices. Bit 6 of the OSC
Global Configuration Register (CR24) must be set to ‘1’ and Address Bits [A15:A12] must be ‘0’ for 16 bit address
qualification.
Note 2
: The Configuration Port is at either 0x02E or 0x04E (for SYSOPT=0 or SYSOPT=1) at power up and can be
relocated via the global configuration registers at 0x26 and 0x27.
Table 68 - Interrupt Select Configuration Register Description
NAME
REG INDEX
0x70 (R/W)
DEFINITION
Primary Interrupt
Select
Default=0x00 or 0x06 (Note 1)
on VCC POR, VTR POR,
PCI RESET and
SOFT RESET
Bits[3:0] selects which interrupt is used for the primary
Interrupt.
0x00= no interrupt selected
0x01= IRQ1
0x02= IRQ2/nSMI
0x03= IRQ3
0x04= IRQ4
0x05= IRQ5
0x06= IRQ6
0x07= IRQ7
0x08= IRQ8
0x09= IRQ9
0x0A= IRQ10
0x0B= IRQ11
0x0C= IRQ12
0x0D= IRQ13
0x0E= IRQ14
0x0F= IRQ15
Notes
:
All interrupts are edge high (except ECP/EPP)
nSMI is active low
Notes:
An Interrupt is activated by setting the Interrupt Request Level Select 0 register to a non-zero value AND:
For the FDC logical device by setting DMAEN, bit D3 of the Digital Output Register.
For the PP logical device by setting IRQE, bit D4 of the Control Port and in addition
For the PP logical device in ECP mode by clearing serviceIntr, bit D2 of the ecr.
For the Serial Port logical device by setting any combination of bits D0-D3 in the IER and by setting the OUT2 bit
in the UART's Modem Control (MCR) Register.
For the KYBD logical device (refer to the KYBD controller section of this spec).
For MPU-401 logical device (refer to the MPU-401 section of this spec).
IRQs are disabled if not used/selected by any Logical Device. Refer to Note A.
nSMI must be disabled to use IRQ2.
All IRQ’s are available in Serial IRQ mode.
Note 1:
The default value of the Primary Interrupt Select register for logical device 0 is 0x06.
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