參數(shù)資料
型號(hào)： LC4032ZC-75T48I
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： PLD
英文描述： 3.3V/2.5V/1.8V In-System Programmable SuperFAST High density PDLs
中文描述： EE PLD, 7.5 ns, PQFP48
封裝： 1 MM HEIGHT, TQFP-48
文件頁數(shù)： 43/91頁
文件大?。?/td> 851K
代理商： LC4032ZC-75T48I
Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
43
ispMACH 4000V/B/C/Z Power Supply and NC Connections
1
Signal
44-pin TQFP
2
48-pin TQFP
2
56-ball csBGA
3
100-pin TQFP
2
128-pin TQFP
2
VCC
11, 33
12, 36
K2, A9
25, 40, 75, 90
32, 51, 96, 115
VCCO0
VCCO (Bank 0)
6
6
F3
13, 33, 95
3, 17, 30, 41, 122
VCCO1
VCCO (Bank 0)
28
30
E8
45, 63, 83
58, 67, 81, 94, 105
GND
12, 34
13, 37
H3, C8
1, 26, 51, 76
1, 33, 65, 97
GND (Bank 0)
5
5
D3
7, 18, 32, 96
10, 24, 40, 113, 123
GND (Bank 1)
27
29
G8
46, 57, 68, 82
49, 59, 74, 88, 104
NC
—
—
4032Z
: A8, B10, E1,
E3, F8, F10, J1, K3
—
—
1. All grounds must be electrically connected at the board level. However, for the purposes of I/O current loading, grounds are associated with
the bank shown.
2. Pin orientation follows the conventional order from pin 1 marking of the top side view and counter-clockwise.
3. Pin orientation A1 starts from the upper left corner of the top side view with alphabetical order ascending vertically and numerical order
ascending horizontally.
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PDF描述
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