Specifications ispLSI 5256VA 8 Figure 6. Boundary Scan Register Circuit for I/O Pins Figure 7. Boundary Scan Register Circuit for Input-Only Pi" />
參數(shù)資料
型號(hào)： ISPLSI 5256VA-100LB208
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 26/27頁(yè)
文件大?。?/td> 0K
描述： IC PLD ISP 192I/O 10NS 208FPBGA
標(biāo)準(zhǔn)包裝： 90
系列： ispLSI® 5000VA
可編程類(lèi)型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 10.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 8
宏單元數(shù)： 256
門(mén)數(shù)： 12000
輸入/輸出數(shù)： 144
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 208-BGA
供應(yīng)商設(shè)備封裝： 208-FPBGA（17x17）
包裝： 托盤(pán)
其它名稱(chēng)： ISPLSI5256VA-100LB208
Specifications ispLSI 5256VA
8
Figure 6. Boundary Scan Register Circuit for I/O Pins
Figure 7. Boundary Scan Register Circuit for Input-Only Pins
Normal
Function
OE
EXTEST
Update DR
SCANOUT
(to next cell)
Clock DR
SCANIN
(from previous
cell)
Shift DR
Normal
Function
TOE
DQ
D
1
0
1
0
1
0
Q
DQ
I/O Pin
Reset
BSCAN
Registers
BSCAN
Latches
HIGHZ
0
PROG_MODE
EXTEST
1
0
1
SCANOUT
(to next cell)
Clock DR
SCANIN
(from previous
cell)
Shift DR
DQ
Input Pin
0
1
相關(guān)PDF資料
PDF描述
ASM28DRSN-S288 CONN EDGECARD 56POS .156 EXTEND
ISPLSI 5256VA-70LB208 IC PLD ISP 192I/O 15NS 208FPBGA
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