Specifications ispLSI 5256VA 5 Figure 3. ispLSI 5000V Generic Logic Block (GLB) GLB_5K 01 266 67 Macrocell 0 PT 160 PT 161 PT 162 PT 163 Macroc" />
參數(shù)資料
型號(hào): ISPLSI 5256VA-100LB208
廠商: Lattice Semiconductor Corporation
文件頁(yè)數(shù): 23/27頁(yè)
文件大?。?/td> 0K
描述: IC PLD ISP 192I/O 10NS 208FPBGA
標(biāo)準(zhǔn)包裝: 90
系列: ispLSI® 5000VA
可編程類(lèi)型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 10.0ns
電壓電源 - 內(nèi)部: 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目: 8
宏單元數(shù): 256
門(mén)數(shù): 12000
輸入/輸出數(shù): 144
工作溫度: 0°C ~ 70°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 208-BGA
供應(yīng)商設(shè)備封裝: 208-FPBGA(17x17)
包裝: 托盤(pán)
其它名稱: ISPLSI5256VA-100LB208
Specifications ispLSI 5256VA
5
Figure 3. ispLSI 5000V Generic Logic Block (GLB)
GLB_5K
01 266 67
Macrocell 0
PT 160
PT 161
PT 162
PT 163
Macrocell 1
Macrocell 15
Macrocell 31
PT 9
PT 8
PT 7
PT 6
PT 5
PT 0
PT 1
PT 2
PT 3
PT 4
PT 79
PT 78
PT 77
PT 76
PT 75
PT 159
PT 158
PT 157
PT 156
PT 155
To I/O Pad
To GRP
PTSA bypass
PT Clock
PT Reset
PT Preset
From PTSA
PTOE
Shared PT Clock 0
Shared PT (P)reset 0
Shared PT Clock 1
Shared PT (P)reset 1
Global PTOE 0 ... 5
6
To I/O Pad
To GRP
PTSA bypass
PT Clock
PT Reset
PT Preset
From PTSA
PTOE
Shared PT Clock 0
Shared PT (P)reset 0
Shared PT Clock 1
Shared PT (P)reset 1
Global PTOE 0 ... 5
6
To I/O Pad
To GRP
PTSA bypass
PT Clock
PT Reset
PT Preset
From PTSA
PTOE
Shared PT Clock 0
Shared PT (P)reset 0
Shared PT Clock 1
Shared PT (P)reset 1
Global PTOE 0 ... 5
6
To I/O Pad
To GRP
PTSA bypass
PT Clock
PT Reset
PT Preset
From PTSA
PTOE
Shared PT Clock 0
Shared PT (P)reset 0
Shared PT Clock 1
Shared PT (P)reset 1
Global PTOE 0 ... 5
6
From Global Routing Pool
PTSA
Programmable
AND Array
Global PTOE Bus
PT 164
相關(guān)PDF資料
PDF描述
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ISPLSI5256VA-125LB208 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類(lèi)型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100