參數(shù)資料
型號： IDTCV145NLG
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 145 SERIES, PLL BASED CLOCK DRIVER, 19 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC72
封裝： GREEN, VFQFPN-72
文件頁數(shù)： 11/13頁
文件大?。?/td> 116K
代理商： IDTCV145NLG
COMMERCIALTEMPERATURERANGE
IDTCV145
1-TO-19DIFFERENTIALCLOCKBUFFER
7
BYTE 2
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
PLL_BW#adjust
HIGH BW
LOW BW
RW
1
6
BYPASS# test mode / PLL
Bypass
PLL
RW
1
5
DIF_13
OutputEnable
Tristate
Enable
RW
1
4
DIF_12
OutputEnable
Tristate
Enable
RW
1
3
DIF_11
OutputEnable
Tristate
Enable
RW
1
2
DIF_10
OutputEnable
Tristate
Enable
RW
1
DIF_9
OutputEnable
Tristate
Enable
RW
1
0
DIF_8
OutputEnable
Tristate
Enable
RW
1
BYTE 3
Bit
Output(s)Affected
Description / Function
0
1
Type
Power On
7
Readback - OE#_9 Input
R
6
Readback - OE#_8 Input
R
5
Readback - OE#_7 Input
Dependsonthestateofthepin
R
4
Readback - OE#_6 Input
R
3
Readback - OE#_5 Input
R
2
Readback-OE#_01234Input
R
1
Readback - HIGHBW# Input
Latchvalueofpinatpower-up
R
0
Readback - SA2/PLL/BYPASS# Input
Latchvalueofpinatpower-up
R
BYTE 0
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
Group of 17 gear #
GRselection
1:1 = In
RW
1
DIF [16:0] Speed selection
6
Group of 2 gear #
GRselection
1:1 = In
RW
1
DIF[18:17]Speedselection
5
Reserved
RW
1
4
FSAlatchedinput
RW
3
SMBus3
RW
2
SMBus2
RW
1
SMBus1
RW
0
SMBus0
RW
BYTE 1
Bit
Output(s)Affected
Description/Function
0
1
Type
Power On
7
DIF_7
OutputEnable
Tristate
Enable
RW
1
6
DIF_6
OutputEnable
Tristate
Enable
RW
1
5
DIF_5
OutputEnable
Tristate
Enable
RW
1
4
DIF_4
OutputEnable
Tristate
Enable
RW
1
3
DIF_3
OutputEnable
Tristate
Enable
RW
1
2
DIF_2
OutputEnable
Tristate
Enable
RW
1
DIF_1
OutputEnable
Tristate
Enable
RW
1
0
DIF_0
OutputEnable
Tristate
Enable
RW
1
CONTROLREGISTERS
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PDF描述
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參數(shù)描述
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