參數(shù)資料
型號(hào): IDTCV125PAG
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: XO, clock
英文描述: PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
中文描述: 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝: LEAD FREE, TSSOP-56
文件頁(yè)數(shù): 10/24頁(yè)
文件大?。?/td> 159K
代理商: IDTCV125PAG
COMMERCIAL TEMPERATURE RANGE
10
IDTCV125
PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
BY TE 13
Bit
0
1
2
3
4
5
6
7
Output(s) Affected
48MHzStr0
48MHStr1
REFStr0
REFStr1
PCIStrC0
PCIStrC1
PCIFStr0
PCIFStr1
Description / Function
0
1
Type
RW
RW
RW
RW
RW
RW
RW
RW
Power On
0
0
0
0
0
0
0
0
USB48MHz0 strength selection
REF strength selection
PCI strength selection
PCIF strength selection
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
V
IH
Input HIGH Voltage
3.3V ± 5%
2
V
DD
+ 0.3
V
V
IL
Input LOW Voltage
3.3V ± 5%
V
SS
- 0.3
0.8
V
V
IH
_FS
LOW Voltage, HIGH Threshold
For FSA.B.C test_mode
0.7
V
DD
+ 0.3
V
V
IL
_FS
LOW Voltage, LOW Threshold
For FSA.B.C test_mode
V
SS
- 0.3
0.35
V
I
IH
Input HIGH Current
V
IN
= V
DD
–5
5
μA
I
IL1
Input LOW Current
V
IN
= 0V, inputs with no pull-up resistors
–5
μA
I
IL2
Input LOW Current
V
IN
= 0V, inputs with pull-up resistors
–200
μA
I
DD3.3OP
Operating Supply Current
Full active, C
L
= full load
400
mA
I
DD3.3PD
Powerdown Current
All differential pairs driven
All differential pairs tri-stated
70
12
mA
F
I
Input Frequency
(1)
Pin Inductance
(2)
V
DD
= 3.3V
14.31818
MHz
L
PIN
7
nH
C
IN
C
OUT
C
INX
Logic inputs
Output pin capacitance
XTAL_IN
5
6
5
Input Capacitance
(2)
pF
C
OUTX
XTAL_OUT
12
T
STAB
Clock Stabilization
(2,3)
Modulation Frequency
(2)
T
DRIVE
_SRC
(2)
T
DRIVE
_PD
(2)
T
FALL
_PD
(2)
T
RISE
_PD
(3)
T
DRIVE
_CPU_STOP#
(2)
T
FALL
_CPU_STOP#
(2)
T
RISE
_CPU_STOP#
(3)
FromV
DD
power-up or de-assertion of PD to first clock
1.8
ms
Triangular modulation
30
33
KHz
SRC output enable after PCI_STOP#de-assertion
15
ns
CPU output enable after PD de-assertion
300
us
Fall time of PD
5
ns
Rise time of PD
5
ns
CPU output enable after CPU_STOP#de-assertion
10
us
Fall time of CPU_STOP#
5
ns
Rise time of CPU_STOP#
5
ns
ELECT RICAL CHARACT ERIS T ICS - INPUT / S UPPLY / COMMON OUT PUT
PARAMETERS
Following Conditions Apply Unless Otherwise Specified:
Operating Condition: T
A
= 0°C to +70°C, Supply Voltage: V
DD
= 3.3V ± 5%
NOTES:
1.
2.
3.
Input frequency should be measured at the REF output pin and tuned to ideal 14.31818MHz to meet ppmfrequency accuracy on PLL outputs.
This parameter is guaranteed by design, but not 100% production tested.
See TIMING DIAGRAMS for timng requirements.
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