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參數(shù)資料
| 型號： | IDTCV125PA |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | XO, clock |
| 英文描述： | PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR |
| 中文描述： | 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56 |
| 封裝： | TSSOP-56 |
| 文件頁數(shù)： | 21/24頁 |
| 文件大小： | 159K |
| 代理商： | IDTCV125PA |
COMMERCIAL TEMPERATURE RANGE
IDTCV125
PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
21
Symbol
Parameter
Min.
Typ.
Max.
Unit
μ
s
t
PZL
Output Enable Delay (All Outputs)
(1)
0
—
10
t
PZH
t
PLZ
Output Disable Delay (All Outputs)
(1)
0
—
10
μ
s
t
PHZ
t
STABLE
All Clock Stabilization fromPower-Up
(2)
—
—
3
ms
t
SPREAD
Setting Period for Spread Selection Change
(2,3)
—
—
3
ms
MISCELLANEOUS AC TIMING REQUIREMENTS
Following Conditions Apply Unless Otherwise Specified:
Operating Condition: T
A
= 0°C to +70°C
NOTES:
1. These specifications apply to the LVDS and SMBus pins. These pins must be tri-stated when P
WRDWN
is asserted. LVDS is driven differential when P
WRDWN
is de-asserted unless
it is disabled.
2. The time specified is fromwhen V
DD
achieves its nomnal operating level (typical condition V
DD
= 3.3V) and P
WRDWN
is de-asserted until the frequency output is stable and operating
within specification.
3. The time specified is measured fromthe spread selection change or output frequency change until the LVDS clock is operating at the new spread modulation and frequency.
If there is another change in spread selection or output frequency during the t
SPREAD
settling period, then the settling period start resets to the most recent change in spread selection
and output frequency.
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