參數(shù)資料
型號(hào)： IDTCV125PA
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類(lèi)： XO, clock
英文描述： PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
中文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封裝： TSSOP-56
文件頁(yè)數(shù)： 14/24頁(yè)
文件大?。?/td> 159K
代理商： IDTCV125PA
COMMERCIAL TEMPERATURE RANGE
14
IDTCV125
PROGRAMMABLE FLEXPC CLOCK FOR P4 PROCESSOR
PCI STOP FUNCTIONALITY
The PCI_STOP#signal is on an active low input controlling PCI and SRC outputs. If PCIF[1:0] and SRC clocks can be set to be free-running through SMBus
programmng, they will ignore both the PCI_STOP#pin and the PCI_STOP register bit.
PCI_STOP# ASSERTION (TRANSITION FROM ‘1’ TO ‘0’)
The clock samples the PCI_STOP#signal on a rising edge of PCIF clock. After detecting the PCI_STOP#assertion low, all PCI[6:0] and stoppable PCIF[1:0]
clocks will latch low on their next high to low transition. After the PCI clocks are latched low, the SRC clock, (if set to stoppable) will latch high at I
REF
*6 (or
tristate if Byte 2 Bit 6 = 1) upon its next low to high transition and the SRC#will latch low as shown below.
PCI_STOP# - DE-ASSERTION
The de-assertion of the PCI_STOP#signal is to be sampled on the rising edge of the PCIF free running clock domain. After detecting PCI_STOP#de-assertion,
all PCI[6:0], stoppable PCIF[1:0] and stoppable SRC clocks will resume in a glitch free manner.
PCI_STOP#
PCIF[1:0] 33MHz
PCI[3:0] 33MHz
SRC 100MHz
SRC# 100MHz
t
SU
PCI_STOP#
PCIF[1:0] 33MHz
PCI[3:0] 33MHz
SRC 100MHz
SRC# 100MHz
t
SU
t
DRIVE_SRC
PCI_STOP#
1
0
CPU
Normal
Normal
CPU#
Normal
Normal
SRC
Normal
I
REF
*6 or float
SRC#
Normal
Low
PCIF/PCI
33MHz
Low
USB
48MHz
48MHz
DOT96
Normal
Normal
DOT96#
Normal
Normal
REF
14.318MHz
14.318MHz
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PDF描述
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