參數(shù)資料
型號(hào)： IDT82V3358EDG
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 28/139頁
文件大?。?/td> 0K
描述： IC PLL WAN SYNC ETHERNET 64TQFP
標(biāo)準(zhǔn)包裝： 160
類型： 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH，Stratum
輸入： CMOS，LVDS，PECL
輸出： CMOS，LVDS，PECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:4
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622.08MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 64-TQFP-EP（10x10）
包裝： 托盤
IDT82V3358
SYNCHRONOUS ETHERNET WAN PLL
Electrical Specifications
123
May 19, 2009
8.4
JITTER & WANDER PERFORMANCE
Table 47: Output Clock Jitter Generation
Test Definition 1
Peak to Peak
Typ
RMS
Typ
Note
Test Filter
25 MHz with T4 APLL
<1 ns
16 ps
See Table 48: Output Clock Phase Noise for details 1.875 MHz - 20 MHz
<1 ns
22 ps
12 kHz - 20 MHz
125 MHz with T4 APLL
<1 ns
4.3 ps
See Table 48: Output Clock Phase Noise for details 1.875 MHz - 20 MHz
<1 ns
15 ps
12 kHz - 20 MHz
156.25 MHz with T4 APLL
<1 ns
6.9 ps
See Table 48: Output Clock Phase Noise for details 1.875 MHz - 20 MHz
<1 ns
25 ps
12 kHz - 20 MHz
N x 2.048 MHz without APLL
<2 ns
<200 ps
20 Hz - 100 kHz
N x 2.048 MHz with T0/T4 APLL
<1 ns
<100 ps
20 Hz - 100 kHz
N x 1.544 MHz without APLL
<2 ns
<200 ps
10 Hz - 40 kHz
N x 1.544 MHz with T0/T4 APLL
<1 ns
<100 ps
10 Hz - 40 kHz
44.736 MHz without APLL
<2 ns
<200 ps
100 Hz - 800 kHz
44.736 MHz with T0/T4 APLL
<1 ns
<100 ps
100 Hz - 800 kHz
34.368 MHz without APLL
<2 ns
<200 ps
10 Hz - 400 kHz
34.368 MHz with T0/T4 APLL
<1 ns
<100 ps
10 Hz - 400 kHz
62.5 MHz with T4 APLL
<1 ns
4.6 ps
See Table 48: Output Clock Phase Noise for details 1.875 MHz - 20 MHz
OC-3
(Chip T0 DPLL + T0/T4 APLL) 6.48 MHz, 19.44 MHz,
25.92 MHz, 38.88 MHz, 51.84 MHz, 77.76 MHz, 155.52
MHz, 311.04 MHz, 622.08 MHz output
0.004 UI p-p 0.001 UI RMS
GR-253, G.813 Option 2
limit 0.1 UI p-p
(1 UI-6430 ps)
12 kHz - 1.3 MHz
0.004 UI p-p 0.001 UI RMS
G.813 Option 1, G.812
limit 0.5 UI p-p
(1 UI-6430 ps)
500 Hz - 1.3 MHz
0.001 UI p-p 0.001 UI RMS
G.813 Option 1
limit 0.1 UI p-p
(1 UI-6430 ps)
65 kHz - 1.3 MHz
OC-12
(Chip T0 DPLL + T0/T4 APLL) 6.48 MHz, 19.44 MHz,
25.92 MHz, 38.88 MHz, 51.84 MHz, 77.76 MHz, 155.52
MHz, 311.04 MHz, 622.08 MHz output + Intel GD16523
+ Optical transceiver)
0.018 UI p-p 0.007 UI RMS
GR-253, G.813 Option 2
limit 0.1 UI p-p
(1 UI-1608 ps)
12 kHz - 5 MHz
0.028 UI p-p 0.009 UI RMS
G.813 Option 1, G.812
limit 0.5 UI p-p
(1 UI-1608 ps)
1 kHz - 5 MHz
0.002 UI p-p 0.001 UI RMS
G.813 Option 1, G.812
limit 0.1 UI p-p
(1 UI-1608 ps)
250 kHz - 5 MHz
STM-16
(Chip T0 DPLL + T0/T4 APLL) 6.48 MHz, 19.44 MHz,
25.92 MHz, 38.88 MHz, 51.84 MHz, 77.76 MHz, 155.52
MHz, 311.04 MHz, 622.08 MHz output + Intel GD16523
+ Optical transceiver)
0.162 UI p-p 0.03 UI RMS
G.813 Option 1, G.812
limit 0.5 UI p-p
(1 UI-402 ps)
5 kHz - 20 MHz
0.01 UI p-p 0.009 UI RMS
G.813 Option 1, G.812
limit 0.1 UI p-p
(1 UI-402 ps)
1 MHz - 20 MHz
Note:
1. CMAC E2747 TCXO is used.
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