- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄1924 > IDT82P2284BB (IDT, Integrated Device Technology Inc)TXRX T1/J1/E1 4CHAN 208-PBGA PDF資料下載
參數(shù)資料
| 型號： | IDT82P2284BB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 57/363頁 |
| 文件大小： | 0K |
| 描述： | TXRX T1/J1/E1 4CHAN 208-PBGA |
| 標(biāo)準(zhǔn)包裝： | 10 |
| 類型： | 收發(fā)器 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 1.8V, 3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-BGA |
| 供應(yīng)商設(shè)備封裝： | 208-PBGA（17x17） |
| 包裝： | 托盤 |
| 其它名稱： | 82P2284BB |
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IDT82P2284
QUAD T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Pin Description
15
February 25, 2008
RSFS[1] / MRSFS
RSFS[2]
RSFS[3]
RSFS[4]
Output / Input
N5
R4
N4
R3
RSFS[1:4]: Receive Side System Frame Pulse for Link 1 ~ 4
In T1/J1 Receive Clock Master mode, RSFSn outputs the pulse to indicate each F-bit, every second F-bit in
SF frame, the first F-bit of every SF/ESF/T1 DM/SLC-96 multi-frame or the first F-bit of every second SF
multi-frame.
In T1/J1 Receive Clock Slave mode, RSFSn inputs the pulse at a rate of integer multiple of 125
s to indicate
the start of a frame.
In E1 Receive Clock Master mode, RSFSn outputs the pulse to indicate the Basic frame, CRC Multi-frame,
Signaling Multi-frame, or both the CRC Multi-frame and Signaling Multi-frame, or the TS1 and TS16 over-
head.
In E1 Receive Clock Slave mode, RSFSn inputs the pulse at a rate of integer multiple of 125
s to indicate
the start of a frame.
RSFSn is updated/sampled on the active edge of the corresponding RSCKn. The active polarity of RSFSn is
selected by the FSINV bit (b4, T1/J1-048H,... / b4, E1-048H,...).
MRSFS: Multiplexed Receive Side System Frame Pulse for Link 1 ~ 4
In Receive Multiplexed mode, MRSFS inputs the pulse at a rate of integer multiple of 125
s to indicate the
start of a frame on the multiplexed data bus. MRSFS is sampled on the active edge of MRSCK. The active
polarity of MRSFS is selected by the FSINV bit (b4, T1/J1-048H,... / b4, E1-048H,...).
RSFS[1:4]/MRSFS are Schmitt-triggered inputs/outputs with pull-up resistors.
RSCK[1] / MRSCK
RSCK[2]
RSCK[3]
RSCK[4]
Output / Input
P5
T4
P4
T3
RSCK[1:4]: Receive Side System Clock for Link 1 ~ 4
In Receive Clock Master mode, the RSCKn pins output a (gapped) 1.544 MHz (for T1/J1 mode) / 2.048 MHz
(for E1 mode) clock used to update the signal on the corresponding RSDn, RSIGn and RSFSn pins.
In Receive Clock Slave mode, the RSCKn pins input a 1.544 MHz (for T1/J1 mode only), 2.048 MHz or 4.096
MHz clock used to update the signals on the corresponding RSDn and RSIGn pins and sample the signals on
the corresponding RSFSn pins. Selected by the RSLVCK bit (b4, T1/J1-010H / b4, E1-010H), the RSCK[1]
pin can be used for all four links.
MRSCK: Multiplexed Receive Side System Clock for Link 1 ~ 4
In Receive Multiplexed mode, MRSCK inputs a 8.192 MHz or 16.384 MHz clock used to update the signals on
the corresponding MRSDA/MRSDB and MRSIGA/MRSIGB pins and sample the signal on the corresponding
MRSFS pin.
RSCK[1:4]/MRSCK are Schmitt-triggered inputs/outputs with pull-up resistors.
TSD[1] / MTSDA[1]
TSD[2] / MTSDB[1]
TSD[3]
TSD[4]
Input
G2
F2
G3
F3
TSD[1:4]: Transmit Side System Data for Link 1 ~ 4
The data stream from the system side is input on these pins.
In Transmit Clock Master mode, the TSDn pins are sampled on the active edge of the corresponding TSCKn.
In Transmit Clock Slave mode, selected by the TSLVCK bit (b1, T1/J1-010H / b1, E1-010H), the TSDn pins
are sampled on the active edge of the corresponding TSCKn or all four TSDn pins are sampled on the active
edge of TSCK[1].
MTSDA[1] / MTSDB[1]: Multiplexed Transmit Side System Data A / B for Link 1 ~ 4
In Transmit Multiplexed mode, selected by the MTSDA bit (b2, T1/J1-010H / b2, E1-010H), the MTSDA[1] pin
or the MTSDB[1] pin is used to input the data stream. Using a byte-interleaved multiplexing scheme, the
MTSDA[1]/MTSDB[1] pins input the data for Link 1 to Link 4. The data on the MTSDA[1]/MTSDB[1] pins are
sampled on the active edge of MTSCK.
TSD[1:4]/MTSDA[1]/MTSDB[1] are Schmitt-triggered inputs.
Name
Type
Pin No.
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT82P2288BBG | TXRX OCTAL T1/E1/J1 256-PBGA |
| IDT82P2521BHG | IC LIU E1 21+1CH SHORT 640-PBGA |
| IDT82P2816BBG | IC LINE INTERFACE UNIT 416-PBGA |
| IDT82P2821BH | IC LIU T1/J1/E1 21+1CH 640-PBGA |
| IDT82P2828BHG | IC LIU T1/J1/E1 28+1CH 640-PBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IDT82P2284BB8 | 功能描述:TXRX T1/J1/E1 4CHAN 208-PBGA RoHS:否 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類型:收發(fā)器 驅(qū)動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2284BBG | 功能描述:TXRX T1/J1/E1 4CHAN 208-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:2,500 系列:- 類型:驅(qū)動器 驅(qū)動器/接收器數(shù):4/0 規(guī)程:RS422 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:16-SOIC N 包裝:帶卷 (TR) |
| IDT82P2284BBG8 | 功能描述:TXRX T1/J1/E1 4CHAN 208-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類型:收發(fā)器 驅(qū)動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR) |
| IDT82P2288 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Octal T1/E1/J1 Long Haul Short Haul Transceiver |
| IDT82P2288_08 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:Octal T1/E1/J1 Long Haul / Short Haul Transceiver |
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